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lpc2210


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PHILIPS 单片 16/32 位微控制器-LPC2210
1. 介绍
对代码规模有严格控制的 LPC2210 是

基于一个支持实时仿真和跟踪的 16/32 位 ARM7TDMI-STM CPU。 应用可使用 16 位 Thumb 模式将代码规模降低超过 30%,而性能的损失却很小。 由于 LPC2210 的 144 脚封装、极低的功耗、多个 32 位定时器、8 路 10 位 ADC、PWM 输出以及多达 9 个外部中断使它们特别适用于工业控制、医疗系统、访问控制和电子收款机(POS)。通过配置总线, LPC2210 最多可提供 76 个 GPIO。由于内置了宽范围的串行通信接口,LPC2210 也非常适合于通信网关、 协议转换器、嵌入式软件调制解调器以及其它各种类型的应用。

2. 特性
2.1 主要特性 16/32 位 ARM7TDMI-S 核,LQFP144 封装。 16 kB 片内静态 RAM。 串行 boot 装载程序通过 UART0 来实现在系统下载和编程。 EmbeddedICE-RT 和嵌入式跟踪接口使用片内 RealMonitor 软件对任务进行实时调试并支持对执 行代码进行无干扰的高速实时跟踪。 8 路 10 位 A/D 转换器,转换时间低至 2.44?s。 2 个 32 位定时器(带 4 路捕获和 4 路比较通道) 、PWM 单元(6 路输出) 、实时时钟和看门狗。 多个串行接口,包括 2 个 16C550 工业标准 UART、高速 I2C 接口(400 kbit/s)和 2 个 SPI 接口。 向量中断控制器。可配置优先级和向量地址。 通过外部存储器接口可将存储器配置成 4 组,每组的容量高达 16Mb,数据宽度为 8/16/32 位。 多达 76 个通用 I/O 口(可承受 5V 电压) 个边沿或电平触发的外部中断引脚。 ,9 通过片内锁相环(PLL)可实现最大为 60MHz 的 CPU 操作频率。 片内晶振频率范围:1~30 MHz。 2 个低功耗模式:空闲和掉电。 通过外部中断将处理器从掉电模式中唤醒。 可通过个别使能/禁止外部功能来优化功耗。 双电源 -CPU 操作电压范围:1.65~1.95 V(1.8 V± 0.15 V) -I/O 操作电压范围:3.0~3.6 V(3.3 V± 10%),可承受 5V 电压。

3. 订购信息
表1 订购信息 封装 名称 LPC2210FBD144 LQFP144 描述 144 脚,本体 20×20×1.4mm 版本 SOT486-1 产品编号

1

广州周立功单片机发展有限公司 Tel: (020)38730976 3.1 订购选项 表2 产品选项 FLASH RAM 16 kB 产品编号 LPC2210FBD144

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CAN -

温度范围(℃) -40~+85

4. 结构框图

(1)

当用作测试/调试接口时,GPIO/其它共用这些管脚的功能不可用。 图1 结构框图

2

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5. 管脚信息
5.1 管脚排列

图 2 LQFP144 管脚排列

3

广州周立功单片机发展有限公司 Tel: (020)38730976 5.2 管脚描述 表3 管脚名称 管脚描述 管脚号 59,61,68,69, 75,76,78, 83-85,92,99, 100,101, 121-123,4-6, 8,21,23,25,3, 2,33 P0.0 P0.1 42 49 O O I O I P0.2 P0.3 50 58 I/O I I/O O I P0.4 P0.5 P0.6 P0.7 59 61 68 69 I/O I I/O O I/O I I O I P0.8 P0.9 75 76 O O I O I P0.10 P0.11 P0.12 P0.13 78 83 84 85 O I I I I O O O 类 型 I/O

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P0.0~P0.31 42,49,50,58,

P0 口:P0 口是一个 32 位双向 I/O 口。每个位都有独立的方向控制。P0 口管脚的操作取决于管脚连接模块所选择的功能。P0 口的 P0.26 和 P0.31 不可用。

TxD0-UART0 的发送器输出 PWM1-脉宽调制器输出 1 RxD0-UART0 的接收器输入 PWM3-脉宽调制器输出 3 EINT0-外部中断 0 输入 SCL-I2C 时钟输入/输出。开漏输出(符合 I2C 规范) CAP0.0-定时器 0 捕获输入 0 SDA-I2C 数据输入/输出。开漏输出(符合 I2C 规范) MAT0.0-定时器 0 匹配输出 0 EINT1-外部中断 1 输入 SCK0-SPI0 串行时钟,主机输出或从机输入的时钟 CAP0.1-定时器 0 捕获输入 1 MISO0-SPI0 主机输入/从机输出,从机到主机的数据传输 MAT0.1-定时器 0 匹配输出 1 MOSI0-SPI0 主机输出/从机输入,主机到从机的数据传输 CAP0.2-定时器 0 捕获输入 2 SSEL0-SPI0 从机选择。选择 SPI 接口用作从机。 PWM2-脉宽调制器输出 2 EINT2-外部中断 2 输入 TxD1-UART1 的发送器输出 PWM4-脉宽调制器输出 4 RxD1-UART1 的接收器输入 PWM6-脉宽调制器输出 6 EINT3-外部中断 3 输入 RTS1-UART1 请求发送输出 CAP1.0-定时器 1 捕获输入 0 CTS1-UART1 的清零发送输入 CAP1.1-定时器 1 捕获输入 1 DSR1-UART1 的数据设置就绪输入 MAT1.0-定时器 1 匹配输出 0 DTR1-UART1 的数据终端就绪输出 MAT1.1-定时器 1 匹配输出 1

4

广州周立功单片机发展有限公司 Tel: (020)38730976 续上表… 管脚名称 P0.14 管脚号 92 类 型 I I

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描 DCD1-UART1 数据载波检测输入 EINT1-外部中断 1 输入



注:当 RESET 为低时,该管脚上的低电平强制复位后由引导装载程序 控制器件的操作。 P0.15 P0.16 99 100 I I I O I P0.17 101 I I/O O P0.18 121 I I/O O P0.19 122 O I/O I P0.20 123 O I I P0.21 P0.22 P0.23 P0.24 P0.25 P0.27 4 5 6 8 21 23 O I I O I/O I/O I/O I I O P0.28 25 I I O P0.29 32 I I O P0.30 33 I I I RI1-UART1 铃声指示输入 EINT2-外部中断 2 输入 EINT0-外部中断 0 输入 MAT0.2-定时器 0 匹配输出 2 CAP0.2-定时器 0 捕获输入 2 CAP1.2-定时器 1 捕获输入 2 SCK1-SPI1 串行时钟,主机输出或从机输入的时钟 MAT1.2-定时器 1 匹配输出 2 CAP1.3-定时器 1 捕获输入 3 MISO1-SPI1 主机输入/从机输出,从机到主机的数据传输 MAT1.3-定时器 1 匹配输出 3 MAT1.2-定时器 1 匹配输出 2 MOSI1-SPI1 主机输出/从机输入,主机到从机的数据传输 CAP1.2-定时器 1 捕获输入 2 MAT1.3-定时器 1 匹配输出 3 SSEL1-SPI1 从机选择。选择 SPI 接口用作从机。 EINT3-外部中断 3 输入 PWM5-脉宽调制器输出 5 CAP1.3-定时器 1 捕获输入 3 CAP0.0-定时器 0 捕获输入 0 MAT0.0-定时器 0 匹配输出 0 通用双向数字 I/O 口 通用双向数字 I/O 口 通用双向数字 I/O 口 AIN0-A/D 转换输入 0。该模拟输入总是连接到相应的管脚上。 CAP0.1-定时器 0 捕获输入 1 MAT0.1-定时器 0 匹配输出 1 AIN1-A/D 转换输入 1。该模拟输入总是连接到相应的管脚上。 CAP0.2-定时器 0 捕获输入 2 MAT0.2-定时器 0 匹配输出 2 AIN2-A/D 转换输入 2。该模拟输入总是连接到相应的管脚上。 CAP0.3-定时器 0 捕获输入 3 MAT0.3-定时器 0 匹配输出 3 AIN3-A/D 转换输入 3。该模拟输入总是连接到相应的管脚上。 EINT3-外部中断 3 输入 CAP0.0-定时器 0 捕获输入 0

5

广州周立功单片机发展有限公司 Tel: (020)38730976 续上表… 管脚名称 P1.0~P1.31 管脚号 91,90,34,24, 15,7,102,95, 86,82,70,60, 52,144,140, 126,113,43 P1.0 P1.1 P1.16 P1.17 P1.18 P1.19 P1.20 91 90 34 24 15 7 102 O O O O O O O 类 型 I/O

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P1 口:P1 口是一个 32 位双向 I/O 口。每个位都有独立的方向控制。P1 口管脚的操作取决于管脚连接模块所选择的功能。P1 口的 P1.0~P1.15 不可用。

CS0-片选信号 0,低电平有效 (Bank0 地址范围:8000 0000 – 80FF FFFF) OE-输出使能信号,低电平有效。 TRACEPKT0-跟踪包位 0,带内部上拉的标准 I/O 口。 TRACEPKT1-跟踪包位 1,带内部上拉的标准 I/O 口。 TRACEPKT2-跟踪包位 2,带内部上拉的标准 I/O 口。 TRACEPKT3-跟踪包位 3,带内部上拉的标准 I/O 口。 TRACESYNC-跟踪同步。带内部上拉的标准 I/O 口。 注:当 RESET 为低时,TRACESYNC 上的低电平会使 P1.25:16 在复位 后作为跟踪端口。

P1.21 P1.22 P1.23 P1.24 P1.25 P1.26

95 86 82 70 60 52

O O O O I I/O

PIPESTAT0-流水线状态位 0,带内部上拉的标准 I/O 口。 PIPESTAT1-流水线状态位 1,带内部上拉的标准 I/O 口。 PIPESTAT2-流水线状态位 2,带内部上拉的标准 I/O 口。 TRACECLK-跟踪时钟。带内部上拉的标准 I/O 口。 EXTIN0-外部触发输入。带内部上拉的标准 I/O 口。 RTCK-返回的测试时钟输出。JTAG 端口的额外信号。当处理器频率 变化时帮助调试器保持同步。带内部上拉的双向口。 注:当 RESET 为低时,RTCK 上的低电平会使 P1.31:26 在复位后作为 调试端口。

P1.27 P1.28 P1.29 P1.30 P1.31 P2.0-P2.31

144 140 126 113 43 98,105,106, 108,109, 114-118,120, 124,125,127, 129-134,136, 137,1,10-13, 16-20

O I I I I I/O

TDO-JTAG 接口测试数据输出。 TDI-JTAG 接口测试数据输入。 TCK-JTAG 接口测试时钟。 TMS-JTAG 接口测试模式选择。 TRST -JTAG 接口的测试复位。 P2 口:P2 口是一个 32 位双向 I/O 口。每个位都有独立的方向控制。P2 口管脚的操作取决于管脚连接模块所选择的功能。

P2.0 P2.1 P2.2 P2.3 P2.4

98 105 106 108 109

I/O I/O I/O I/O I/O

D0-外部存储器数据线 0 D1-外部存储器数据线 1 D2-外部存储器数据线 2 D3-外部存储器数据线 3 D4-外部存储器数据线 4

6

广州周立功单片机发展有限公司 Tel: (020)38730976 续上表… 管脚名称 P2.5 P2.6 P2.7 P2.8 P2.9 P2.10 P2.11 P2.12 P2.13 P2.14 P2.15 P2.16 P2.17 P2.18 P2.19 P2.20 P2.21 P2.22 P2.23 P2.24 P2.25 P2.26 管脚号 114 115 116 117 118 120 124 125 127 129 130 131 132 133 134 136 137 1 10 11 12 13 类型 I/O I/O I/O I/O I/O I/O I/O I/O I/O I/O I/O I/O I/O I/O I/O I/O I/O I/O I/O I/O I/O I/O I P2.27 16 I/O I

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描 D5-外部存储器数据线 5 D6-外部存储器数据线 6 D7-外部存储器数据线 7 D8-外部存储器数据线 8 D9-外部存储器数据线 9 D10-外部存储器数据线 10 D11-外部存储器数据线 11 D12-外部存储器数据线 12 D13-外部存储器数据线 13 D14-外部存储器数据线 14 D15-外部存储器数据线 15 D16-外部存储器数据线 16 D17-外部存储器数据线 17 D18-外部存储器数据线 18 D19-外部存储器数据线 19 D20-外部存储器数据线 20 D21-外部存储器数据线 21 D22-外部存储器数据线 22 D23-外部存储器数据线 23 D24-外部存储器数据线 24 D25-外部存储器数据线 25 D26-外部存储器数据线 26



BOOT0-当 RESET 为低时, BOOT0 与 BOOT1 一同控制引导和内部操 作。管脚的内部上拉确保了管脚未连接时呈现高阻态。 D27-外部存储器数据线 27 BOOT1-当 RESET 为低时, BOOT1 与 BOOT0 一同控制引导和内部操 作。管脚的内部上拉确保了管脚未连接时呈现高阻态。 BOOT1:0=00 选择引导 CS0 控制的 8 位存储器。 BOOT1:0=01 选择引导 CS0 控制的 16 位存储器。 BOOT1:0=10 选择引导 CS0 控制的 32 位存储器。 BOOT1:0=11 选择引导 CS0 控制的 16 位存储器。

P2.28 P2.29 P2.30 P2.31

17 18 19 20

I/O I/O I/O I I/O I

D28-外部存储器数据线 28 D29-外部存储器数据线 29 D30-外部存储器数据线 30 AIN4-A/D 转换输入 4。该模拟输入总是连接到相应的管脚上。 D31-外部存储器数据线 31 AIN5-A/D 转换输入 5。该模拟输入总是连接到相应的管脚上。

7

广州周立功单片机发展有限公司 Tel: (020)38730976 续上表… 管脚名称 P3.0-P3.31 管脚号 89-87,81, 80,74-71, 66-62,56, 55,53, 48-44,41, 40,36,35, 30-27,97,96 P3.0 P3.1 P3.2 P3.3 P3.4 P3.5 P3.6 P3.7 P3.8 P3.9 P3.10 P3.11 P3.12 P3.13 P3.14 P3.15 P3.16 P3.17 P3.18 P3.19 P3.20 P3.21 P3.22 P3.23 89 88 87 81 80 74 73 72 71 66 65 64 63 62 56 55 53 48 47 46 45 44 41 40 O O O O O O O O O O O O O O O O O O O O O O O O O P3.24 P3.25 P3.26 P3.27 P3.28 36 35 30 29 28 O O O O O I 类型 I/O

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P3 口:P3 口是一个 32 位双向 I/O 口,每位的方向可单独控制。P3 口 的功能取决于管脚连接模块的管脚功能选择。

A0-外部存储器地址线 0。 A1-外部存储器地址线 1。 A2-外部存储器地址线 2。 A3-外部存储器地址线 3。 A4-外部存储器地址线 4。 A5-外部存储器地址线 5。 A6-外部存储器地址线 6。 A7-外部存储器地址线 7。 A8-外部存储器地址线 8。 A9-外部存储器地址线 9。 A10-外部存储器地址线 10。 A11-外部存储器地址线 11。 A12-外部存储器地址线 12。 A13-外部存储器地址线 13。 A14-外部存储器地址线 14。 A15-外部存储器地址线 15。 A16-外部存储器地址线 16。 A17-外部存储器地址线 17。 A18-外部存储器地址线 18。 A19-外部存储器地址线 19。 A20-外部存储器地址线 20。 A21-外部存储器地址线 21。 A22-外部存储器地址线 22。 A23-外部存储器地址线 23。 XCLK-时钟输出。 CS3-片选信号 3,低电平有效。 (Bank 3 地址范围为 8300 0000 – 83FF FFFF) CS2-片选信号 2,低电平有效。 (Bank 2 地址范围为 8200 0000 – 82FF FFFF) CS1-片选信号 1,低电平有效。 (Bank 1 地址范围为 8100 0000 – 81FF FFFF) WE-写使能信号,低电平有效。 BLS3-字节定位选择信号(Bank 3) ,低电平有效。 AIN7-A/D 转换输入 7。该模拟输入总是连接到相应的管脚上。 8

广州周立功单片机发展有限公司 Tel: (020)38730976 续上表… 管脚名称 P3.29 管脚号 27 类型 O I P3.30 P3.31 RESET 97 96 135 O O I

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BLS2-字节定位选择信号(Bank 2) ,低电平有效。 AIN6-A/D 转换输入 6。该模拟输入总是连接到相应的管脚上。 BLS1-字节定位选择信号(Bank 1) ,低电平有效。 BLS0-字节定位选择信号(Bank 0) ,低电平有效。 外部复位输入。该管脚的低电平将器件复位,并使 I/O 口和外围功能恢 复默认状态,处理器从地址 0 开始执行。带迟滞的 TTL 电平,管脚可承 受 5V 电压。

XTAL1 XTAL2 VSS

142 141 3,9,26,38, 54,67,79, 93,103, 107,111, 128

I O I

振荡器电路和内部时钟发生器的输入。 振荡放大器的输出。 地:0V 参考点。

VSSA VSSA_PLL V18 V18A V3

139 138 37, 110 143 2,31,39, 51,57,77,94, 104,112,119

I I I I I

模拟地:0V 参考点。标称电压与 VSS 相同,但应当互相隔离以减少噪声 和故障。 PLL 模拟地:0V 参考点。标称电压与 VSS 相同,但应当互相隔离以减少 噪声和故障。 1.8V 内核电源:内部电路的电源。 模拟 1.8V 内核电源:内部电路的电源。标称电压与 V18 相同,但应当互 相隔离以减少噪声和故障。 3.3V 端口电源:I/O 口的电源。

V3A

14

I

模拟 3.3V 端口电源:标称电压与 V3 相同,但应当互相隔离以减少噪声 和故障。

6.

功能描述
在下面章节中对 LPC2210 的系统和外围功能作详细的描述。

6.1

结构概述 ARM7TDMI-S 是一个通用的 32 位微处理器,它可提供高性能和低功耗。ARM 结构是基于精简指令集

计算机(RISC)原理而设计的。指令集和相关的译码机制比复杂指令集计算机要简单得多。这样使用一个小 的、廉价的处理器核就可实现很高的指令吞吐量和实时的中断响应。 由于使用了流水线技术,处理和存储系统的所有部分都可连续工作。通常在执行一条指令的同时对下 一条指令进行译码,并将第三条指令从存储器中取出。 ARM7TDMI-S 处理器使用了一个被称为 THUMB 的独特的结构化策略, 它非常适用于那些对存储器有 限制或者需要较高代码密度的大批量产品的应用。 在 THUMB 后面一个关键的概念是“超精简指令集” 。ARM7TDMI-S 处理器基本上具有两个指令集: 标准 32 位 ARM 指令集 16 位 THUMB 指令集 9

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THUMB 指令集的 16 位指令长度使其可以达到标准 ARM 代码两倍的密度,却仍然保持 ARM 的大多 数性能上的优势, 这些优势是使用 16 位寄存器的 16 位处理器所不具有的。 这是因为 THUMB 代码和 ARM 代码一样,在相同的 32 位寄存器上进行操作。 THUMB 代码仅为 ARM 代码规模的 65%,但其性能却相当于连接到 16 位存储器系统的相同 ARM 处 理器性能的 160%。 6.2 片内静态 RAM 片内静态 RAM 可用作代码和/或数据的存储。SRAM 支持 8 位、16 位和 32 位访问。LPC2210 具有 16 kB SRAM。 6.3 存储器映射 LPC2210 的存储器映射包含几个不同的区域,见图 3。 此外,CPU 的中断向量可以重新映射,这样允许它们位于片内引导装载程序,外部存储器 BANK0 或 者片内静态 RAM 当中。详见 6.19 节“系统控制”。
4.0 GB AHB 外设 3.75 GB VPB 外设 3.5 GB 保留地址空间 3.0 GB 外部存储器 BANK3 外部存储器 BANK2 外部存储器 BANK1 外部存储器 BANK0 2.0 GB BOOT 块 (从片内ROM存储器重新映射) 0x8400 0000 0x83FF FFF 0x8300 0000 0x82FF FFF 0x8200 0000 0x81FF FFF 0x8100 0000 0x80FF FFF 0x8000 0000 0x7FFF FFF 0x7FFF E00 0x7FFF DFF 0xFFFF FFF 0xF000 000 0xEFFF FFF 0xE000 000 0xDFFF FFF

保留地址空间 0x4004 0000 0x4000 3FF 0x4000 0000 0x3FFF FFF

16 K字节片内静态RAM 1.0 GB

保留地址空间

0.0 GB

0x0000 0000

图 3 LPC2210 存储器映射 6.4 中断控制器 向量中断控制器(VIC)接收所有的中断请求输入,并将它们编程分配为 3 类:FIQ、向量 IRQ 和非向量 IRQ。可编程分配机制意味着不同外设的中断优先级可以动态分配和调整。

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快速中断请求(FIQ)具有最高优先级。如果分配给 FIQ 的请求多于 1 个,VIC 将中断请求“相或”向 ARM 处理器产生 FIQ 信号。当只有一个被分配为 FIQ 时可实现最短的 FIQ 等待时间,因为 FIQ 服务程序 只要简单地启动器件的处理就可以了。但如果分配给 FIQ 级的中断多于 1 个,FIQ 服务程序从 VIC 中读出 一个字以识别产生中断请求的 FIQ 中断源是哪一个。 向量 IRQ 具有中等优先级。该级别可分配 16 个中断请求。中断请求中的任意一个都可分配到 16 个向 量 IRQ slot 中的任意一个,其中 slot0 具有最高优先级,而 slot15 则为最低优先级。 非向量 IRQ 的优先级最低。 VIC 将所有向量和非向量 IRQ 组合后向 ARM 处理器产生 IRQ 信号。 IRQ 服务程序可通过读取 VIC 的 一个寄存器立即启动并跳转到相应地址。如果有任意一个向量 IRQ 发出请求,VIC 则提供最高优先级请求 IRQ 服务程序的地址,否则提供默认程序的地址,该默认程序由所有非向量 IRQ 共用。默认程序可读取另 一个 VIC 寄存器以确定哪个 IRQ 被激活。 6.4.1 中断源 表 4 所列为每个外围功能的中断源。每个外设都有一条中断线连接到向量中断控制器,但可能有几个 内部中断标志。单个中断标志也可能代表不同的中断源。 表4 WDT ARM 内核 ARM 内核 定时器 0 定时器 1 UART0 中断源 模块 看门狗中断(WDINT) 只保留给软件中断使用 EmbeddedICE, DbgCommRx EmbeddedICE, DbgCommTx 匹配 0-3(MR0, MR1, MR2, MR3) 匹配 0-3(MR0, MR1, MR2, MR3) Rx 线状态(RLS) 发送保持寄存器空(THRE) Rx 数据可用(RDA) 字符超时指示(CTI) UART1 Rx 线状态(RLS) 发送保持寄存器空(THRE) Rx 数据可用(RDA) 字符超时指示(CTI) 调制解调器状态中断(MSI) PWM0 IC SPI0 SPI1 PLL RTC 系统控制
2

标志

VIC 通道# 0 1 2 3 4 5 6

7

匹配 0-6(MR0, MR1, MR2, MR3, MR4, MR5, MR6) SI(状态改变) SPIF, MODF SPIF, MODF PLL 时钟(PLOCK) RTCCIF(计数器增加),RTCALF(报警) 外部中断 0(EINT0) 外部中断 1(EINT1) 外部中断 2(EINT2) 外部中断 3(EINT3)

8 9 10 11 12 13 14 15 16 17 18

A/D

A/D 转换器

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广州周立功单片机发展有限公司 Tel: (020)38730976 6.5 管脚连接模块

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管脚连接模块允许将微控制器的管脚配置为不同的功能。配置寄存器控制连接管脚和片内外设的多路 开关。应当在激活外设以及使能任何相关的中断之前,将外设连接到相应的管脚。任何一个被使能的外设, 如果其功能没有映射到相关的管脚,对它的激活将被认为是未定义的。 管脚连接模块包含 3 个寄存器,见表 5。 表5 管脚连接模块寄存器 名称 PINSEL0 PINSEL1 PINSEL2 描述 管脚功能选择寄存器 0 管脚功能选择寄存器 1 管脚功能选择寄存器 2 访问 读/写 读/写 读/写 地址 0xE002C000 0xE002C004 0xE002C014

6.6 管脚功能选择寄存器 0(PINSEL0 – 0xE002C000) PINSEL0 寄存器控制表 6 所列管脚的功能。IODIR 寄存器中的方向控制位只有在 GPIO 功能应用到管 脚时才有效。对于其它功能,方向自动进行控制。表 6 所列设定之外的设定都被保留,用户不要使用这些 保留设定。 表 6 管脚功能选择寄存器 0(PINSEL0 – 0xE002C000) PINSEL0 管脚名称 0 1:0 P0.0 0 1 1 0 3:2 P0.1 0 1 1 0 5:4 P0.2 0 1 1 0 7:6 P0.3 0 1 1 0 9:8 P0.4 0 1 1 0 11:10 P0.5 0 1 1 值 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 GPIO P0.0 TxD (UART0) PWM1 保留 GPIO P0.1 RxD (UART0) PWM3 EINT0 GPIO P0.2 SCL (I2C) 捕获 0.0 (定时器 0) 保留 GPIO P0.3 SDA (I2C) 匹配 0.0 (定时器 0) EINT1 GPIO P0.4 SCK (SPI0) 捕获 0.1 (定时器 0) 保留 GPIO P0.5 MISO (SPI0) 匹配 0.1 (定时器 0) 保留 0 0 0 0 0 0 功 能 复位值

12

广州周立功单片机发展有限公司 Tel: (020)38730976 续上表… PINSEL0 管脚名称 0 13:12 P0.6 0 1 1 0 15:14 P0.7 0 1 1 0 17:16 P0.8 0 1 1 0 19:18 P0.9 0 1 1 0 21:20 P0.10 0 1 1 0 23:22 P0.11 0 1 1 0 25:24 P0.12 0 1 1 0 27:26 P0.13 0 1 1 0 29:28 P0.14 0 1 1 0 31:30 P0.15 0 1 1 值 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1

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功 GPIO P0.6 MOSI (SPI0) 捕获 0.2 (定时器 0) 保留 GPIO P0.7 SSEL (SPI0) PWM2 EINT2 GPIO P0.8 TxD UART1 PWM4 保留 GPIO P0.9 RxD (UART1) PWM6 EINT3 GPIO P0.10 RTS (UART1) 捕获 1.0 (定时器 1) 保留 GPIO P0.11 CTS (UART1) 捕获 1.1 (定时器 1) 保留 GPIO P0.12 DSR (UART1) 匹配 1.0 (定时器 1) 保留 GPIO P0.13 DTR (UART1) 匹配 1.1 (定时器 1) 保留 GPIO P0.14 DCD (UART1) EINT1 保留 GPIO P0.15 RI (UART1) EINT2 保留



复位值

0

0

0

0

0

0

0

0

0

0

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6.7 管脚功能选择寄存器 1(PINSEL1 – 0xE002C004) PINSEL1 寄存器控制表 7 所列管脚的功能。IODIR 寄存器中的方向控制位只有在 GPIO 功能应用到管 脚时才有效。对于其它功能,方向自动进行控制。表中所列设定之外的设定都被保留,用户不要使用这些 保留设定。 表7 管脚功能选择寄存器 1(PINSEL1 – 0xE002C004) 管脚名称 0 1:0 P0.16 0 1 1 0 3:2 P0.17 0 1 1 0 5:4 P0.18 0 1 1 0 7:6 P0.19 0 1 1 0 9:8 P0.20 0 1 1 0 11:10 P0.21 0 1 1 0 13:12 P0.22 0 1 1 0 15:14 P0.23 0 1 1 0 17:16 P0.24 0 1 1 值 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 GPIO P0.16 EINT0 匹配 0.2 (定时器 0) 捕获 0.2 (定时器 0) GPIO P0.17 捕获 1.2 (定时器 1) SCK (SPI1) 匹配 1.2 (定时器 1) GPIO P0.18 捕获 1.3 (定时器 1) MISO (SPI1) 匹配 1.3 (定时器 1) GPIO P0.19 匹配 1.2 (定时器 1) MOSI (SPI1) 捕获 1.2 (定时器 1) GPIO P0.20 匹配 1.3 (定时器 1) SSEL (SPI1) EINT3 GPIO P0.21 PWM5 保留 捕获 1.3 (定时器 1) GPIO P0.22 保留 捕获 0.0 (定时器 0) 匹配 0.0 (定时器 0) GPIO P0.23 保留 保留 保留 GPIO P0.24 保留 保留 保留 0 0 0 0 0 0 0 0 0 功 能 复位值 PINSEL1

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广州周立功单片机发展有限公司 Tel: (020)38730976 续上表… PINSEL1 管脚名称 0 19:18 P0.25 0 1 1 0 21:20 P0.26 0 1 1 0 23:22 P0.27 0 1 1 0 25:24 P0.28 0 1 1 0 27:26 P0.29 0 1 1 0 29:28 P0.30 0 1 1 0 31:30 P0.31 0 1 1 值 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1

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功 能 GPIO P0.25 保留 保留 保留 保留 保留 保留 保留 GPIO P0.27 AIN0 (A/D 输入 0) 捕获 0.1 (定时器 0) 匹配 0.1 (定时器 0) GPIO P0.28 AIN1 (A/D 输入 1) 捕获 0.2 (定时器 0) 匹配 0.2 (定时器 0) GPIO P0.29 AIN2 (A/D 输入 2) 捕获 0.3 (定时器 0) 匹配 0.3 (定时器 0) GPIO P0.30 AIN3 (A/D 输入 0) EINT3 捕获 0.0 (定时器 0) 保留 保留 保留 保留

复位值

0

0

1

1

1

1

0

6.8 管脚功能选择寄存器 2(PINSEL2 – 0xE002C014) PINSEL2 寄存器控制表 8 所列管脚的功能。IODIR 寄存器中的方向控制位只有在 GPIO 功能应用到管 脚时才有效。对于其它功能,方向自动进行控制。表中所列设定之外的设定都被保留,用户不要使用这些 保留设定。 表8 1:0 2 3 管脚功能选择寄存器 2(PINSEL2 – 0xE002C014) 复位值 - P1.26/RTCK P1.20 / TRACESYNC 保留 为 0 时,P1.31:26 作为通用 I/O 口。为 1 时,P1.31:26 作为调试端口。 为 0 时,P1.25:16 作为通用 I/O 口。为 1 时,P1.25:16 作为跟踪端口。 PINSEL2 位 功能

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广州周立功单片机发展有限公司 Tel: (020)38730976 续上表… PINSEL2 位 功能 5:4 控制数据总线和选通管脚的使用: 管脚 P2.7:0 管脚 P1.0 管脚 P1.1 管脚 P3.31 管脚 P2.15:8 管脚 P3.30 管脚 P2.27:16 管脚 P2.29:28 管脚 P2.31:30 管脚 P3.29:28 6 7 8 10:9 11 12 13 15:14 17:16 19:18 20 21 22 23 为 1 时使能 AIN6。 11=P2.7:0 11=P1.0 11=P1.1 11=P3.31 00 或 11=P2.15:8 00 或 11=P3.30

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复位值 BOOT1:0 0x 或 10=D7:0 0x 或 10=CS0 0x 或 10=OE 0x 或 10=BLS0 01 或 10=D15:8 01 或 10=BLS1 10=D27:16 10=D29:28 10=D31:30 10=BLS2:3 1 1 0 0 0 00 00 0 1 1

0x 或 11=P2.27:16 0x 或 11=P2.29:28 或保留 0x 或 11=P2.31:30 或 AIN5:4 0x 或 11=P3.29:28 或 AIN6:7

如果位 5:4 不为 10, 由该位控制 P3.29 脚的使用: 0 时使能 P3.29, 为 如果位 5:4 不为 10, 由该位控制 P3.28 脚的使用: 0 时使能 P3.28, 为 为 1 时使能 AIN7。 该位控制 P3.27 脚的使用:为 0 时使能 P3.27,为 1 时使能 WE。 保留。 该位控制 P3.26 脚的使用:为 0 时使能 P3.26,为 1 时使能 CS1。 保留。 如果位 25:23 不为 111,由该位控制 P3.23/A23/XCLK 脚的使用:为 0 时使能 P3.23,为 1 时使能 XCLK。 控制 P3.25 脚的使用:00 使能 P3.25,01 使能 CS2,10 和 11 保留。 控制 P3.24 脚的使用:00 使能 P3.24,01 使能 CS3,10 和 11 保留。 保留。 如果位 5:4 不为 10,由该位控制 P2.29:28 的使用:0 使能 P2.29:28, 1 保留。 如果位 5:4 不为 10,由该位控制 P2.30 的使用:0 使能 P2.30,1 使 能 AIN4。 如果位 5:4 不为 10,由该位控制 P2.31 的使用:0 使能 P2.31,1 使 能 AIN5。 控制 P3.0/A0 用作端口管脚(0)或地址线(1) 。

如 果 RESET = 0 时 BOOT1:0=00, 该位的复位值为 1。反之为 0。

24 27:25

控制 P3.1/A1 用作端口管脚(0)或地址线(1) 。 控制 P3.23/A23/XCLK 和 P3.22:2/A2.22:2 中地址线的数目: 000=无地址线 001=A3:2 为地址线 010=A5:2 为地址线 011=A7:2 为地址线 100=A11:2 为地址线 101=A15:2 为地址线 110=A19:2 为地址线 111=A23:2 为地址线 如 果 复 位 时 BOOT1:0=11,该 域的复位值为 000。反之为 111。

31:28

保留。

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广州周立功单片机发展有限公司 Tel: (020)38730976 6.9 外部存储器控制器

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外部存储器控制器是一个为系统总线和外部(片外)存储器器件提供接口的功能模块。它可同时支持 4 个可单独配置的存储器组的工作(每个存储器组的容量为 16M 字节,带有字节定位使能控制) 。每个存储 器组都支持 SRAM、ROM、Flash EPROM、Burst ROM 存储器或一些外部 I/O 器件。 每个存储器组的总线宽度为 8、16 或 32 位。 6.10 通用并行 I/O 口 没有连接到特定外设功能的管脚由 GPIO 寄存器进行控制。管脚可以动态配置为输入或输出。寄存器 可以同时对任意个输出口进行置位或清零。输出寄存器的值以及管脚的当前状态都可以读出。 6.10.1 特性 单个位的方向控制 输出置位和清零可单独控制 所有 I/O 在复位后的默认状态都为输入 6.11 10 位 A/D 转换器 LPC2210 分别包含一个带 8 路输入的 10 位逐次逼近模-数转换器。 6.11.1 特性 测量范围:0~3V 每秒可执行 400,000 次 10 位采样 单路或多路输入的突发转换模式 根据输入脚的跳变或定时器匹配信号执行转换 6.12 UART LPC2210 包含 2 个 UART。一个 UART 提供一个完全的调制解调器控制握手接口。另一个 UART 只有 发送和接收数据线。 6.12.1 特性 16 字节接收和发送 FIFO 寄存器位置遵循 550 工业标准 接收器 FIFO 触发点为 1、4、8 和 14 个字节 内置波特率发生器 UART1 包含标准调制解调器接口信号 6.13 I2C 接口 I2C 是一个双向总线,它使用两条线:串行时钟线(SCL) 和串行数据线(SDA) 实现互连芯片的控制。 每个器件都通过一个唯一的地址来识别,这些器件可以是只接收器件(例如 LCD 驱动器) ,或是可以发送 和接收信息的发送器(例如存储器) 。发送器和/或接收器可以操作为主或从模式,这取决于芯片是启动数 据的发送还是只被寻址。I2C 是一个多主总线,它可以由超过一个总线主控器进行控制。 LPC2210 所包含的 I2C 功能支持 400kbit/s(快速 I2C) 。

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广州周立功单片机发展有限公司 Tel: (020)38730976 6.13.1 特性 标准的 I2C 总线接口 可配置为主机、从机或主/从机 可编程时钟可实现通用速率控制 主机从机之间双向数据传输 多主机总线(无中央主机)

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同时发送的主机之间进行仲裁,避免了总线数据的冲突 串行时钟同步使器件在一条串行总线上实现不同位速率的通信 串行时钟同步可作为握手机制使串行传输挂起和恢复 I2C 总线可用于测试和诊断 6.14 SPI 接口 LPC2210 包含 2 个 SPI 接口。SPI 是一个全双工的串行接口,它设计成可以处理在一个给定总线上多 个互连的主机和从机。在一定数据传输过程中,接口上只能有一个主机和一个从机通信。在一次数据传输 中,主机总是向从机发送一个字节数据,而从机也总是向主机发送一个字节数据。 6.14.1 特性 遵循串行外设接口(SPI)规范 同步、串行、全双工通信 组合的 SPI 主机和从机 最大数据位速率为输入时钟速率的 1/8 6.15 通用定时器 定时器对外设时钟周期(PCLK)进行计数,可选择产生中断或基于 4 个匹配寄存器,在到达指定的定时 值时执行其它动作。它还包括 4 个捕获输入,用于在输入信号发生跳变时捕获定时器值,并可选择产生中 断。多个管脚通过‘或’‘与’ 、 ,可以实现捕获、匹配或‘广播’功能。 6.15.1 特性 带可编程 32 位预分频器的 32 位定时器/计数器 每个定时器的 4 个 32 位捕获通道可在输入信号跳变时捕获定时器的瞬时值。捕获事件可选择产 生中断。 4 个 32 位匹配寄存器: -连续操作,可选择在匹配时产生中断 -匹配时停止定时器,可选择产生中断 -匹配时复位定时器,可选择产生中断 每个定时器有 4 个对应于匹配寄存器的外部输出,具有下列特性: -匹配时置低电平 -匹配时置高电平 -匹配时翻转 -匹配时不变 6.16 看门狗定时器 看门狗定时器的用途是使微控制器在进入错误状态经过一段时间后复位。当看门狗使能时,如果没有 在预先确定的时间内“喂” (重装)看门狗,它将会产生一次系统复位。

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广州周立功单片机发展有限公司 Tel: (020)38730976 6.16.1 特性 如果没有周期性重装,则产生片内复位 调试模式

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由软件使能,但要求禁止硬件复位或看门狗复位/中断 错误/不完整的喂狗时序会导致复位/中断(如果使能) 指示看门狗复位的标志 带内部预分频器的可编程 32 位定时器 可选择时间周期:从(tpclk×256×4) 到 (tpclk×232×4),可选值为 tpclk×4 的倍数 6.17 实时时钟 当选择正常或空闲模式时,实时时钟(RTC)提供一套用于测量时间的计数器。RTC 消耗的功率非常低, 这使其适合于由电池供电的,CPU 不连续工作(空闲模式)的系统。 6.17.1 特性 对时间段进行测量以实现一个日历或时钟 超低功耗设计,支持电池供电系统 提供秒、分、小时、日、月、年和星期 可编程基准时钟分频器允许调节 RTC 以适应不同的晶振频率 6.18 脉宽调制器(PWM) PWM 基于标准的定时器模块并具有其所有特性。不过 LPC2210 只将其 PWM 功能输出到管脚。定时 器对外设时钟(pclk)进行计数, 可选择产生中断或者根据 7 个匹配寄存器在到达指定的定时值时执行其它动 作。PWM 功能也建立在匹配寄存器事件基础之上。 独立控制上升和下降沿位置的能力使 PWM 可以应用于更多的领域。 例如, 多相位电机控制通常需要 3 个非重叠的 PWM 输出,而这 3 个输出的脉宽和位置需要独立进行控制。 两个匹配寄存器可用于提供单边沿控制的 PWM 输出。 匹配寄存器 MR0 通过匹配时重新设置计数值来 控制 PWM 周期率。其它的匹配寄存器控制 PWM 边沿的位置。每个额外的单边沿控制 PWM 输出只需要 一个匹配寄存器, 因为所有 PWM 输出的重复速率是相同的。 多个单边沿控制的 PWM 输出在每个 PWM 周 期的开始并且当 MR0 发生匹配时,都有一个上升沿。 3 个匹配寄存器可用于提供一个双边沿控制 PWM 输出。也就是说,MR0 匹配寄存器控制 PWM 周期 速率,其它匹配寄存器控制两个 PWM 边沿位置。每个额外的双边沿控制 PWM 输出只需要两个匹配寄存 器,因为所有 PWM 输出的重复速率是相同的。 使用双边沿控制 PWM 输出时, 指定的匹配寄存器控制输出的上升和下降沿。 这样就产生了正脉冲 (当 上升沿先于下降沿时)和负脉冲(当下降沿先于上升沿时) 。 6.18.1 特性 7 个匹配寄存器,可实现 6 个单边沿控制或 3 个双边沿控制 PWM 输出,或这两种类型的混合输 出。 匹配寄存器允许执行以下操作: -连续操作,可选择在匹配时产生中断 -匹配时停止定时器,可选择产生中断 -匹配时复位定时器,可选择产生中断 支持单边沿控制和/或双边沿控制的 PWM 输出。 单边沿控制 PWM 输出在每个周期开始时总是为 高电平, 除非输出保持恒定低电平。 双边沿控制 PWM 输出可在一个周期内的任何位置产生边沿。

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广州周立功单片机发展有限公司 Tel: (020)38730976 这样可同时产生正和负脉冲。

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脉冲周期和宽度可以是任何的定时器计数值。 这样可在分辨率和重复速率上获得平衡。 所有 PWM 输出都以相同的重复率发生。 双边沿控制的 PWM 输出可编程为正脉冲或负脉冲。 匹配寄存器更新与脉冲输出同步,防止产生错误的脉冲。软件必须在新的匹配值生效之前将它们 释放。 如果不使能 PWM 模式,可作为一个标准定时器 带可编程 32 位预分频器的 32 位定时器/计数器 6.19 系统控制模块 6.19.1 晶振 振荡器支持晶振范围为 1MHz~30MHz。晶振输出频率称为 FOSC,而 ARM 处理器时钟频率称为 cclk。 除非连接并运行 PLL,否则在该文档中 FOSC 和 cclk 的值是相同的。参见 6.19.2 节“PLL”部分。 6.19.2 PLL PLL 可以接受范围为 10MHz~25MHz 的输入时钟频率。输入频率通过一个电流控制振荡器(CCO) 可以倍增为 10MHz~60MHz。倍增器可以是从 1 到 32 的整数(实际上在该系列微控制器当中,由于 CPU 频率的限制,倍增器的值不可能高于 6) 。CCO 操作的范围为 156MHz~320MHz,因此在环当中增加了一 个分频器,这样 PLL 在提供所需要的输出频率时,使 CCO 保持在其频率范围内。输出分频器可设置为 2、 4、8 或者 16 以产生输出时钟。由于最小输出分频值为 2,这样就确保了 PLL 输出具有 50%的占空比。PLL 在芯片复位后关闭并且被旁路, 可通过软件使能。 程序必须配置并且激活 PLL, 等待 PLL 锁定之后再将 PLL 作为时钟源。 6.19.3 复位和唤醒定时器 LPC2210 有 2 个复位源: RESET 管脚和看门狗复位。 RESET 管脚是一个施密特触发输入管脚,带有 附加的干扰滤波器。任何复位源所导致的芯片复位都会启动唤醒定时器(见下面的唤醒定时器) ,复位状态 将一直保持到外部复位撤除,振荡器开始运行。振荡器运行经过固定数目的时钟后内部电路完成其初始化。 当内部复位撤除后,处理器从复位向量地址 0 开始执行。此时所有的处理器和外设寄存器都被初始化 为预设的值。 唤醒定时器的用途是确保振荡器和其它芯片操作所需要的模拟功能在处理器能够执行指令之前完全正 常工作。这在上电、各种类型的复位以及任何原因所导致上述功能被关闭的情况下非常重要。由于振荡器 和其它功能在掉电模式下关闭,因此将处理器从掉电模式中唤醒就要利用唤醒定时器。 唤醒定时器监视晶体振荡器是否可以安全地开始执行代码。当芯片上电时,或某些事件导致芯片退出 掉电模式时,振荡器需要一定的时间以产生足够振幅的信号驱动时钟逻辑。时间的长度取决于许多因素, 包括 VDD 上升速度(上电时) 、晶振的类型及电气特性(如果使用石英晶体)以及其它外部电路(例如:电 容)和外部环境下振荡器自身的特性。 6.19.4 外部中断输入 根据可选管脚功能的设定,LPC2210 最多可包含 9 个边沿或电平触发的外部中断输入。外部事件可作 为 4 个独立的中断信号来处理。外部中断输入可用于将处理器从掉电状态唤醒。

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广州周立功单片机发展有限公司 Tel: (020)38730976 6.19.5 存储器映射控制

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存储器映射控制改变了从地址 0x00000000 开始的中断向量的映射。向量可以映射到外部存储器 BANK0 的底部,也可以映射到片内静态 RAM。这使得在不同存储器空间中运行的代码都能够对中断进行 控制。 6.19.6 功率控制 LPC2210 支持两种低功耗模式:空闲模式和掉电模式。在空闲模式中,指令的执行被暂停,直到产生 复位或中断为止。外围功能在空闲模式下继续工作并可产生中断唤醒处理器。空闲模式使处理器自身、存 储器系统和相关的控制器以及内部总线不再消耗功率。 在掉电模式中,振荡器被关闭,芯片没有任何的内部时钟。处理器状态和寄存器、外设寄存器和内部 SRAM 的值在掉电模式下保持不变。芯片管脚的逻辑电平保持静态。通过复位或特定的不需要时钟还可工 作的中断可终止掉电模式并恢复正常操作。由于芯片所有动态的操作都被暂停,掉电模式使芯片消耗的功 率降低到几乎为零。 外设的功率控制特性允许关闭单独的不需要使用的外设,这样可进一步降低功耗。 6.19.7 VPB 总线 VPB 分频器决定处理器时钟(cclk)和外设时钟(pclk)之间的关系。VPB 分频器有两个用途。第一,VPB 总线在 ARM 处理器的最高速度下不能正确操作,为了弥补这一点,VPB 总线频率可以降低为处理器时钟 频率的一半或 1/4。VPB 总线在复位后的默认状态是以 1/4 速率运行。VPB 分频器的第二个用途是当所有 外设都不必在全速率下运行时降频以降低功耗。 由于 VPB 分频器连接到 PLL 的输出, (如果正在运行) PLL 在空闲模式时保持有效。 6.20 仿真和调试 LPC2210 支持通过 JTAG 串行端口进行仿真和调试。跟踪端口允许跟踪程序的执行。调试和跟踪功能 只在 GPIO 的 P1 口复用。这意味着位于 P0 口的所有通信、定时器和接口外设在开发和调试阶段都可用。 6.20.1 Embedded ICETM 标准的 ARM EmbeddedICE 逻辑提供对片内调试的支持。对目标系统进行调试需要一个主机来运行调 试软件和 EmbeddedICE 协议转换器。EmbeddedICE 协议转换器将远程调试协议命令转换成所需要的 JTAG 数据,从而对 ARM 内核进行访问。 ARM 内核有一个内置的调试通信通道功能。调试通信通道允许程序在目标系统上运行,即使进入调试 状态,目标系统程序与主机调试器或其它独立的主机进行通信时也不会中断程序流程。ARM7TDMI-S 内核 上运行的程序将调试通信通道作为协处理器 14 进行访问。调试通信通道允许 JTAG 端口发送和接收数据, 但不影响正常的程序流程。调试通信通道数据和控制寄存器映射到 EmbeddedICETM 逻辑中的地址。 6.20.2 嵌入式跟踪 由于 LPC2210 带有大量的片内存储器,因此不能简单地通过观察外部管脚来确定处理器核是如何运行 的。嵌入跟踪宏单元(ETM)对深嵌入处理器内核提供了实时跟踪能力。它向一个跟踪端口输出处理器执 行的信息。 ETM 直接连接到 ARM 内核而不是主 AMBA 系统总线。 它将跟踪信息压缩并通过一个窄带跟踪端口输 出。外部跟踪端口分析仪在软件调试器的控制下捕获跟踪信息。指令跟踪(或 PC 跟踪)显示了处理器的执行 流程并提供所有已执行指令的列表。指令跟踪被压缩为广播分支地址和一套用于指示流水线状态的状态信 号。跟踪信息的产生可通过选择触发源进行控制。触发源包括地址比较器、计数器和序列发生器。由于跟 踪信息被压缩,软件调试器需要一个执行代码的静态映像。由于这个限制,自修改代码无法被跟踪。

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广州周立功单片机发展有限公司 Tel: (020)38730976 6.20.3 RealMonitorTM

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RealMonitor 是一个可配置的软件模块,它由 ARM 公司开发,可以提供实时的调试。它是一个非常轻 便的调试监控器, 当用户对运行在前台的应用程序进行调试时, 它运行在后台。 它使用 DCC(调试通信通道) (EmbeddedICE 逻辑中包含了 DCC)与主机进行通信。LPC2210 包含一个编程到片内存储器中的特定 RealMonitor 软件。

7.

极限参数
表9 符号 V18 V3 V3A AVIN Vi Vi I I Tstg P 1. a). 电源电压,内部线路 电源电压,外部线路 模拟 3.3V 电源电压 A/D 端口模拟输入电压 DC 输入电压,可承受 5V 的 I/O 口 DC 输入电压,其它 I/O 口 DC 电源电流,每个电源脚 DC 地电流,每个地脚 储存温度
6 5 2,3 5 3,4

极限参数

符合绝对最大额定系统(IEC 60134)标准。 参数 最小 -0.5 -0.5 -0.5 -0.5 -0.5 -0.5 - - -40 1.5 最大 +2.5 +3.6 4.6 5.1 6.0 V3+0.5 100 100 125 - 单位 V V V V V V mA mA ℃ W

功率损耗(封装的热传递,而非器件的功耗) 下面是关于极限参数的几点描述:

器件在超过上面所列的极限参数值情况下工作,可能会造成永久性的损坏。表中所列的只 是一些重要参数的额定值,并未说明器件在极限参数或任何条件下(第 8 节“静态特性” 和第 9 节“动态特性”描述的除外)的相应操作。

b). c). 2. 3. 4. 5. 6.

本产品带有保护器件的内部电路设计,避免超负荷造成器件的损坏。不过建议避免在超过 最大值的情况下工作。 参数在操作温度范围内是有效的,除非另有规定。所有的电压都是相对 Vss 而言,除非另 有说明。

不得超过 4.6V。 包含三态模式输出口的电压。 只有在 V3 电源电压存在的情况下有效。 峰值电流限制为对应最大值的 25 倍。 取决于封装的类型。

8.

静态特性
表 10 静态特性 MIN 1.65 3.0 2.5 Vi = 0 Vi = V3 22 TYP 1 1.8 3.3 3.3 MAX 1.95 3.6 3.6 3 3 Tamb=商业级:-40℃~+85℃,除非另有规定

标号 V18 V3 V3A IIL IIH 电源电压

参数

测试条件

单位 V V V ?A ?A

外部线路电源电压 模拟 3.3V 电源电压

标准端口管脚, RESET , RTCK 低电平输入电流,无上拉 高电平输入电流,无下拉 - - - -

广州周立功单片机发展有限公司 Tel: (020)38730976 续上表… 标号 IOZ 参数 三态输出漏电流,无上/下拉 测试条件

38730977

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MIN - 100 0 0 2.0 - -

TYP 1 - - - - - - 0.4 - - - - - - 50 -50 0

MAX 3 - 5.5 V3 - 0.8 - - 0.4 - - -45 50 150 -85 0

单位 ?A mA V V V V V V V mA mA mA mA ?A ?A ?A

VO = 0; VO = V3 -(0.5V3)<V<(1.5V3) Tj <125℃

Ilatchup I/O 闩锁电流 VI VO VIH VIL Vhys VOH VOL IOH IOL IOH IOL IPD IPU 输入电压 3,4,5 输出电压;输出有效 高电平输入电压 低电平输入电压 滞后电压 高电平输出电压 低电平输出电压 高电平输出电流 低电平输出电流 高电平短路电流 低电平短路电流 下拉电流 上 拉 电 流 P1.16~P1.25) ( 施 加 到
6 6 6 6 7 7

IOH = -4mA IOL = -4mA VOH =V3-0.4V VOL = 0.4V VOH = 0 VOL = V3 Vi = 5V Vi = 0 V3 < Vi < 5V Tamb=25℃, 代码:
8 8

V3-0.4 - -4 4 10 -15 0

V1.8 =1.8V, cclk=60MHz 激活模式 I1.8 while(1){} 从片内 RAM 执行, 无激活 外设 掉电模式 V18 =1.8V, Tamb=+25℃ V18 =1.8V, Tamb=+85℃ D26 和/或 D27 用作外部存 储器和/或存储器映射 I/O 口的数据线, 附加的总耗散 电流为 IIkgt - - - - - 10 50 10 - 500 - ?A ?A k? - 30 - mA

BOOT1:0 的下拉引导电阻, 空载数据线 D26 和/或 D27 用来选择系统配置 RPDB

0.7V 70uA + I Ikgt

?

I C 管脚 VIH VIL Vhys VOL Ilkg
高电平输入电压 低电平输入电压 滞后电压 低电平输出电压
6

2

VTOL = 4.5V~5.5V VTOL = 4.5V~5.5V VTOL = 4.5V~5.5V IOL = 3mA VI = V3 VI = 5V

0.7VTOL
- - - - -

- -



V V V V ?A ?A

0.3VTOL


0.5VTOL


0.4 4 22 V18 V18

输入漏电流(到 VSS)

2 10

振荡器管脚

X1 输入电压 X2 输出电压
注:

0 0

- -

1.

不能保证得到典型的标称值。表中所列值为在室温(+25℃)和标称电压下测得。

23

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2. 3. 4. 5. 6. 7. 8.
表 11 标号

管脚电容由其特性得到,但未作测试。 包括三态模式输出上的电压。

V3 电压必须存在。
当 V3 接地时,三态输出进入三态模式。 所有电源线都要将 100mV 的压降计算在内。 只允许持续很短的时间。

Vi 最小为 4.5V,最大为 5.5V。 A/D 转换器 DC 特性
参数 模拟输入电压 模拟输入电容 微分非线性度 积分非线性度 偏移误差 1,5 增益误差 1,6 绝对误差
1,7 1,2,3 1,4

除非另外规定,V3A=2.5~3.6V; Tamb = -40~+85℃; A/D 转换器频率为 4.5MHz。 最小 最大 单位

AVIN CIN DLe ILe OSe Ge Ae

0
- - - - - -

V3A 1 ±1 ±2 ±3 ±0.5 ±4

V pF LSB LSB LSB % LSB

[1] 条件:VSSA=0V,V3A=3.3V。 [2] A/D 转换曲线呈单调变化,无代码丢失。 [3] 微分非线性(DLe)是指实际步距长度与理想步距长度的差异。见图 4。 [4] 积分非线性(ILe)是指实际转换曲线步距中点和增益和偏移误差经适当调节后所得理想转换曲线的峰
值的差异。见表 4。

[5] 偏移误差(OSe)是实际转换曲线所得直线与理想转换曲线所得直线的绝对误差。见表 4。 [6] 增益误差(Ge)是指消除偏移误差后实际转换曲线所得直线与理想转换曲线所得直线之间的相对误差,
用百分数表示。见图 4。

[7] 绝对电压误差(Ae)是指未经校准的 A/D 转换实际转换曲线的步距中心与理想曲线的最大偏差。见图 4。

24

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偏移误差 增益误差 Ge OSe

1023 1022 1021 1020 1019 1018

(2)

7 输出代码 6 5 (5) 4 (4) 3 (3) 2 1 0 1 LSB (理想) 1 2 3 4 5 6 7 1018 1019 1020 1021 1022 1023 1024 (1)

AV IN (LSBideal) 偏移误差 OSe 1 LSB =

(1)实际转换曲线举例 (2)理想转换曲线 (3)差分非线性 (DLe) (4)积分非线性 (ILe) (5)实际转换曲线步距中点

V3A - VSSA 1024

图4

A/D 转换特性

9.

动态特性
表 12 特性 除非另外规定,Tamb=商业级:0℃~+70℃;工业级:-40℃~+85℃;V18 和 V3 处于规格范围内 1。

标号 外部时钟

参数

测试条件

MIN

TYP 1

MAX

单位

fosc

振荡频率,由外部振荡器提供(信 号发生器) 外部时钟频率,由外部晶振提供 如果片内 PLL 被使用,fosc 为外部 时钟频率 如果通过引导装载程序来下载初始 化代码,fosc 为外部时钟频率

1 1 10 10 20 tC×0.4 tC×0.4
- -

- - - - -

50 30 25 25 1000
- -

MHz MHz MHz MHz ns ns ns ns ns ns ns

tC

外部振荡器时钟周期

tCHCX 时钟高电平时间 tCLCX 时钟低电平时间 tCLCH 时钟上升时间 tCHCL 时钟下降时间
端口管脚

5 5

tRISE

输出上升时间 (P0.2, P0.3 除外)

- -

10 10

- -

tFALL 输出下降时间 (P0.2, P0.3 除外) 25

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测试条件

MIN 20 + 0.1×Cb 2

TYP 1

MAX

单位

I C 管脚 tf
注:

2

VIH 到 VIL 的输出下降时间





ns

1. 2.

如果没有另外定义,这些参数在操作温度范围内有效。 总线电容 Cb 范围为 10pF~400pF。

表 13 外部存储器接口 AC 特性(CL=25pF,Tamb=40℃) 符号 读、写周期均适用 描述

Min -5[1] -5
[1]

Max 10 10 10 10 10 10 5 -

单位

tCHAVR tCHCSL tCHCSH tCHANV
读周期参数

XCLK 高到地址有效 XCLK 高到 CS 低 XCLK 高到 CS 高 XCLK 高到地址无效 CS 低到地址有效 OE 低到地址有效 CS 低到 OE 低 CS 为低,OE 低到数据有效)

ns ns ns ns ns ns ns ns ns

tCSLAV tOELAVR tCSLOEL tAVDV tAVDV

-5

存储器访问时序(最新地址有效, (tcyc*(2+WST1))+(-20) 突发 ROM 存储器初始访问时序 (最新地址有效,CS 为低,OE 低 到数据有效)

(tcyc*(2+WST1))+(-20)

tAVDV tSTHDNV tCSHOEH tOEHANV tCHOEL tCHOEH
写周期参数

突发 ROM 存储器连续访问时序 (地址有效到数据有效) 数据保持时间(CS 最初为高,OE 为高,地址改变到数据无效)

tcyc+(-20) 0 -5 -5 -5 -5 tcyc-10[1] -5 -5 -5 -5 -5 tcyc×(1+WST2)-5 tcyc×(1+WST2)-5 tcyc-5

5 5 5 5 5 5 5 5 5 tcyc*(1+WST2)+5 tcyc*(1+WST2)+5 tcyc+5

ns ns ns ns ns ns ns ns ns ns ns ns ns ns ns

CS 高到 OE 高 OE 高到地址无效 XCLK 高到 OE 低 XCLK 高到 OE 高
地址有效到 CS 低

tAVCSLW tCSLDVW tCSLWEL tCSLBLSL tWELDV tCSLDV tWELWEH tWELWEH tWEHANV

CS 低到数据有效 CS 低到 WE 低 CS 低到 BLS 低 WE 低到数据有效 CS 低到数据有效 WE 低到 WE 高 BLS 低到 BLS 高 WE 高到地址无效

26

广州周立功单片机发展有限公司 Tel: (020)38730976 续上表… 符号 描述

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Min (2×tcyc)-5 tcyc-5 (2×tcyc)-5 -

Max (2×tcyc)+5 tcyc+5 (2×tcyc)+5 10 10 10 10 10 10

单位

tWEHDNV tBLSHANV tBLSHDNV tCHDV tCHWEL tCHHBLSL tAVCSL tAVCSL tAVCSL

WE 高到数据无效 BLS 高到地址无效 BLS 高到数据无效 XCLK 高到数据有效 XCLK 高到 WE 低 XCLK 高到 BLS 低 XCLK 高到 WE 高 XCLK 高到 BLS 高 XCLK 高到数据无效

ns ns ns ns ns ns ns ns ns

[1] 初始访问除外,初始访问时地址在 tcyc 有效之前建立。
表 14 标准读访问说明 访问周期 最大频率

WST 设定 WST≥0;四舍五入为整数 t RAM + 20ns ?2 t CYC

存储器访问时间

标准读

fMAX≤ fMAX≤ fMAX≤ fMAX≤

2 + WST1 t RAM + 20ns 1 + WST2 t WRITE + 5ns 2 + WST1 t INIT + 20ns 1 t ROM + 20ns

WST1≥ WST2≥

tRAM≤tCYC×(2+WST1)-20ns tWRITE≤tCYC×(1+WST2)-5ns tINIT≤tCYC×(2+WST1)-20ns tROM≤tCYC-20ns

标准写

t WRITE ? t CYC + 5 t CYC t INIT + 20ns ?2 t CYC N/A

突发读-初始读

WST1≥

突发读-连续读

9.1 时序
XCLK t CS CLSAV t CSHOEH

Addr t Data t AVDV t STHDNV

CSLOEL t OELAVR t CHOEL t OEHANV t CHOEH

OE

图 5 外部存储器读访问

27

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XCLK

CS

t

t AVCSLW

CSLDVW t WELWEH t BLSLBLSH t t

BLS/WE

t t

CSLWEL t

WEHANV

CSLBLSL

WELDV

BLSHANV

Addr t Data t CSLDV t WEHDNV

BLSHDNV

OE

图 6 外部存储器写访问

VDD - 0.5 V 0.45 V

0.2 V DD + 0.9 0.2 V DD - 0.1 V

tCHCX tCLCX tC tCLCH

tCHCL

图 7 外部时钟时序

28

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10.

封装

LQFP144 封装:144 脚;本体 20×20×1.4mm

c

y X

A 108 109 73 72 ZE e

E HE

A A2

A1

(A 3) θ Lp L detail X

wM bp pin 1 index 144 37 1 bp D HD wM ZD B v M B 36 v M A

e

0

5 scale

10 mm

DIMENSIONS (mm are the original dimensions) UNIT mm A max. 1.6 A1 0.15 0.05 A2 1.45 1.35 A3 0.25 bp 0.27 0.17 c 0.20 0.09 D(1) 20.1 19.9 E (1) 20.1 19.9 e 0.5 HD HE L 1 Lp 0.75 0.45 v 0.2 w 0.08 y 0.08 Z D(1) Z E(1) 1.4 1.1 1.4 1.1 θ 7o 0o

22.15 22.15 21.85 21.85

11.

修改记录

2004 年 2 月
第1版

29


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