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锁相环设计与MATLAB仿真


西北工业大学明德学院本科毕业设计论文

本科毕业设计论文

题 目

锁相环设计与 MATLAB 仿真

_______________________________________

专业名称 学生姓名 指导教师 毕业时间

电子科学与技术 何 鹏 李立欣

2010 年 6 月

西北工业大学明德学院本科毕业设计论文

毕业
一、题目

设计 论文

任务书

《锁相环设计与 MATLAB 仿真》 二、指导思想和目的要求
在了解锁相环的基本工作原理的基础上,熟悉其构成及数学模型,在对锁相 环有了充分的要了解后,运用 MATLAB 仿真软件对其进行仿真。通过仿真看锁相 环是否工作正常,参数指标是否合格来判断是否达到了仿真要求。

三、主要技术指标
1.锁相环的基本原理 2.锁相环工作期间是否经历了失锁、跟踪、捕获、锁定等四个状态。 3.锁定后平率相位是否平稳。

四、进度和要求
第 3~5 第 6~8 周:查阅和整理资料文献,确定研究模型和研究方向; 周:分析模型,找出其中的缺陷;

第 9~11 周: 提出更容易实现的结构,对该结构具体分析; 第 11~13 周:整理资料进行论文撰写、装订并翻译英文文献; 第 14~15 周: 论文评阅,答辩准备,答辩

五、主要参考书及参考资料
Floyd M.Gardner,锁相环技术(第三版)姚剑清 译,人民邮电出版社,2007 Roland E.Best,锁相环设计、仿真与应用(第五版) ,李永明 等译,清华学出版 社,2007.4

学生 ___________

指导教师 ___________

系主任 ___________

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中文摘要 ????????????????????????????? 3 英文摘要 ????????????????????????????? 4 前言 ??????????????????????????????? 6 第一章 绪论???????????????????????????? 7 1.1 锁相环的发展及国内外研究现状????????????????? 7 1.2 本文的主要内容组织?????????????????????? 9 第二章 锁相环的基本理论??????????????????????10 2.1 锁相环的工作原理 ??????????????????????11 2.1.1 鉴相器 ?????????????????????????11 2.1.2 低通滤波器??????????????????????? 13 2.1.3 压控振荡器??????????????????????? 15 2.2锁相环的工作状态???????????????????????15 2.3 锁相环的非线性工作性能分析 ????????????????17 2.3.1跟踪性能????????????????????????18 2.3.2捕获性能????????????????????????18 2.3.3失锁状态????????????????????????19 2.4锁相环的稳定性????????????????????????20 2.5信号流程图??????????????????????????21 2.6 锁相环的优良特性?????????????????????? 21 2.7锁相环的应用?????????????????????????22 2.7.1锁相环在调制和解调中的应用????????????????22 2.7.2锁相环在频率合成器中的应用????????????????23 2.8本章小结??????????????????????????? 23 第三章锁相环的噪声分析?????????????????????? 24

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3.1 锁相环的输入噪声??????????????????????24 3.2压控振荡器的噪声???????????????????????24 3.3相位噪声的抑制????????????????????????26 3.4 本章小结?????????????????????????? 27 第四章 二阶锁相环仿真及结果????????????????????28 4.1 仿真介绍?????????????????????????? 28 4.2 程序代码?????????????????????????? 28 4.3 仿真结果?????????????????????????? 34 4.4 本章小结?????????????????????????? 36 结 论??????????????????????????????38

致谢??????????????????????????????? 39 参考文献????????????????????????????? 40 毕业设计小结??????????????????????????? 41

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摘 要

锁相环电路是使一个特殊系统跟踪另外一个系统, 更确切的说是一种输出信 号在频率和相位上能够与输入参考信号同步的电路, 它是模拟及数模混合电路中 的一个基本的而且是非常重要的模块。由于锁相环具有捕获、跟踪和窄带滤波的 作用,因此被应用在通信、微处理器、以及卫星等许多领域。锁相环是通信电路 里时钟电路的一个重要模块。 本文详细介绍了锁相环设计中所涉及的各项指标计。 论文首先对锁相环的发 展历史和研究现状做了介绍, 然后从其基本工作原理出发,以传统锁相环的结构 为基础,得到了锁相环的数学模型,对锁相环的跟踪性能、捕获性能、稳定性以 及噪声性能等各种性能进行了分析,对锁相环的各项指标参数进行了详细推导, 得出了锁相环数学分析的结论。 本文详细描述了锁相环的整体电路以及鉴频鉴相 器、环路滤波器、压控振荡器、分频器等电路模块。在分析和设计的同时,也采 用 MATLAB 软件对电路进行了仿真。由于 MATLAB 仿真软件适合多学科、多 种工作平台且功能强大、界面友好、方便快捷、语言自然并且开放性强的大型优 秀应用软件, 已经也已成为国内外高等院校高等数学、 数值分析、 数字信号处理、 自动控制理论以及工程应用等课程的基本教学工具。使用 Matlab 对锁相环仿真 的实现是方便快捷的。仿真结果表明,锁相环电路达到了设计指标要求。

关键词:锁相环,仿真,MATLAB

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Abstract

Phase-locked loop circuit is to make a special system to track another system, more precisely, an output signal in the frequency and phase reference signal can be synchronized with the input circuit, which is the analog and digital-analog hybrid circuit is very important module. As the PLL has acquisition, tracking and narrowband filtering role, so it is used in communications, microprocessors, and satellite and many other fields. PLL clock circuit of the communication circuit is an important module. This paper describes the design of PLL indicators of dollars involved .Firstly the history of the PLL and the current research have been described, and then from the basic working principle, the structure of the traditional PLL based on a mathematical model has been phase-locked loop, the tracking performance of the PLL capture the performance, stability and noise performance and other performance analysis of the indicators on the PLL parameters detailed derivation, mathematical analysis of the findings of a PLL. This paper describes the overall PLL circuit and frequency discriminator phase detector, loop filter, VCO, frequency divider circuit module, etc.. In the analysis and design, but also by MATLAB software circuit simulation. As the

MATLAB simulation software for multi-disciplinary, multi-working platform and powerful, friendly interface, convenient, natural and open and strong language of large outstanding applications, has also become a domestic and international institutions of higher learning higher mathematics, numerical analysis, digital signal processing, automatic control theory and engineering applications of basic teaching tool for courses. Simulation using Matlab implementation of the PLL is convenient. Simulation results show that the phase-locked loop circuit to the design requirements.

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Keywords:PLL, Simulation, MATLAB

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锁相环(PLL)是一个能够跟踪输入信号相位的闭环自动控制系统。它在无线 电技术的各个领域得到了很广泛的应用。最初, DeBellescize于1932年提出同步 检波理论,首次公开发表了对锁相环路的描述,但并未引起普遍关注。直至1947 年,锁相环路才第一次应用于电视接收机水平和垂直扫描的同步。从此,锁相环 路开始得到了应用。 由于技术上的复杂性以及较高的成本,应用锁相环路的领域 主要集中于航天方面, 包括轨道卫星的测速定规和深空探测等。性能要求较高的 精密测量仪器和通信设备有时也用到它。到70年代,随着集成电路技术的发展, 逐渐出现了集成的环路部件、通用单片集成锁相环路以及多种专用集成锁相环 路,锁相环逐渐变成了一个成本低、使用简单的多功能组件,这就为锁相技术在 更广阔的领域应用提供了条件。 随着数字技术的发展,相应出现了各种数字锁相 环,它们在数字信号传输的载波同步、位同步、相干解调等方面发挥了重要的作 用。 在锁相环的开发、设计研究领域,目前已经探索出多种途径。Lindsey和Chie 讲述了到1981年他们在该领域出色完成的理论研究和实验工作。不过,大量的研 究都致力于通过不同的方式实现环路鉴相器的机械化, 而对于环路滤波器的设计 研究则较少。 典型的设计方法只是简单地实现了在模拟锁相环中应用广泛的离散 式环路滤波器。 这种方法存在缺陷,因为在设计过程中没有考虑到在任何采样数 据系统中都固有的计算延迟。 这些延迟会使环路带宽比根据连续时间方程计算出 的结果更宽, 指定带宽和动态下的稳态相位误差也会更大,进而降低整个环路的 稳定性。 长久以来, 锁相环一直是相位相干通信系统的基石。模拟锁相环一直占据着 统治地位。 随着微电子学领域的快速发展,具备巨大优势的数字化系统开始取代 相应的模拟系统。目前的趋势是用数字化方式设计和实现锁相环。

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第一章 绪 论

1.1 锁相环的发展及国内外研究现状

锁相环(PLL-Phase Locked L00P)是自动频率控制和自动相位控制技术的融 合。人们对锁相环的最早研究始于 20 世纪 30 年代,其在数学理论方面的原理, 30 年代无线电技术发展的初期就己出现。1930 年建立了同步控制理论的基础, 1932 年法国工程师贝尔赛什(Bellescize)发表了锁相环路的数学描述和同步检波 论, 第一次公开发表了对锁相环路的数学描述【1】 。 锁相技术首先被用在同步接收 中, 为同步检波提供一个与输入信号载波同频的本地参考信号,同步检波能够在 低信噪比条件下工作, 且没有大信号检波时导致失真的缺点,因而受到人们的关 注,但由于电路构成复杂以及成本高等原因,当时没有获得广泛应用。 到了 1943 年锁相环路第一次应用于黑白电视接收机水平同步电路中,它可 以抑制外部噪声对同步信号的干扰, 从而避免了由于噪声干扰引起的扫描随机触 发使画面抖动的象,使荧光屏上的电视图像稳定清。随后,在彩色电视接收机中 锁相电路用来同步彩色脉冲串。从此,锁相环路开始得到了应用,迅速发展。 五十年代,随着空间技术的发展,由杰费(Jaffe)和里希廷(Rechtin)研制成功 利用锁相环路作为导弹信标的跟踪滤波器, 他们第一次发表了含有噪声效应的锁 相环路线性理论析文章, 并解决了锁相环路最佳设计化问题【2】 。 空间技术的发展 促进了人们对锁相环路及其理论的进一步探讨,极大地推动了锁相技术的发展。 六十年代初, 维特比(Viterbi)研究了无噪声锁相环路的非线性理论问题, 发 表了相干通信原理的论文。 最初的锁相环都是利用分立元件搭建的,由于技术和 成本方面的原因,所以当时只是用于航天、航空等军事和精密测量等领域。集成 电路技术出现后,直到 1965 年左右,随着半导体技术的发展,第一块锁相环芯 片出现之后【3】 ,锁相环才作为一个低成本的多功能组件开始大量应用各种领域。 最初的锁相环是纯模拟的(APLL),所有的模块都由模拟电路组成,它大多由四

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象限模拟乘法器来构建环路中的鉴相器,环路滤波器为低通滤波器(由电阻 R 电 容 C 组成),压控振荡器的结构多种多样。由于 APLL 在稳定工作时,各模块都 可以认为是线性工作的,所以也称为线性锁相环 LPLL(Linear Phase.hckedbop)。 APLL 对正弦特性信号的相位跟踪非常好,它的环路特性主要由鉴相器的特性决 定。其主要用于对信号的调制。 70 年代, 林特赛(Undsy)和查理斯(Chanes)在做了大量实验的基础上进行了 有噪声的一阶、 二阶及高阶 PLL 的非线性理论分析。随着人们对锁相技术的理论 和应用进行的深入广泛的研究, 伴随着数字电路的发展,鉴相器部分开始由数字 电路代替, 其它部分仍为模拟电路,这种锁相环就是最初的数字锁相环(DPLL), 准确的名称为数模混合锁相环(Mixed-single PLL)。随着数模混合锁相环技术和 理的不断发展和完善,其成为了锁相环的主流。 现在随着通信行中对低成本、 低功耗、 大带宽、 高数据传输速率的需求, 集 成电路不断朝着高集成度、低功耗的方向发展【4】 。低功耗、高工作频率、低电压 的锁相环设计中, 主要的挑战是设计合适的压控振荡器和高频率的分频器,针对 这方面的研究, 设计师们不断提出不同的技术,如压控振荡器和分频器由原来的 串接改为堆叠结构、DH-PLL 结构等,随着设计人员的不断努力,锁相坏的性能 不断提高,现在已经有工作频率达 50GHz 的锁相环,同时也在通信和航空航天 等领域中发挥着越来越重要的作要。 国外自第一个锁相环集成产品问世以来,几十年问发展极为迅速,产品种类 繁多,工艺日新月异。目前,除某些特殊用途的锁相环路外,几乎全部集成了, 已生产出数百个品种。 现在, 锁相技术己经成为一门系统的理论科学, 它在通信、 雷达、航天、精密测量、计算机、红外、激光、原子能、立体声、马达控制以及 图像等技术部门获得了广泛的应用。 美国国家半导体 (Nation Semi Conductor) 于 2003 年 6 月宣布推出的 LMx243x 系列锁相环芯片,其操作频率高达 3GHz 以上,适用于无线局域网、5.8GHz 室内 无绳电话、移动电话及基站等应用方案。低功耗、超低的相位噪声(正常化相位 噪音可达到—219dBcmz)使其突显优势。 国内的浩凯微电子(上海)有限公司于 2007 年底研发出具有完全自主知识产 权的高性能时钟锁相环 IP 系列产品,目前该系列产品已经过 MPW 硅验证。该锁

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相环系列采用全新的结构,独特的电荷泵和差分 VCO 的设计,可以抑制电源和 衬底噪声对 VCO 的影响以确保 PLL 有非常低的噪声,差分 VCO 的独特设计可 以输出时钟维持 50%占空比且与 VCO 同频,由于不需要倍频振荡,VCO 本身 的功耗可降为常规设计的四分之一,有效降低了功耗。相比国外而言,我国国内 的 IC 设计水平相对比较落后,模拟设计环节更是薄弱,PLL 的技术几乎被国外 垄断,国内很少有企业掌握高性能 PLL 核心技术, 产品更是少。CPPLL 作为应 用最广泛的一种锁相环, 虽然它的理论己经比较成熟,但是它的设计与实现涉及 到信号与系统、集成电子学、版图、半导体工艺和测试等方面,难度比较大。

1.2 本文的主要内容组织

第一章对锁相环的发展和国内外研究现状进行了介绍,说明了本课题研究的 重要意义。 第二章介绍了锁相环的基本原理,介绍了锁相环的基本构成、数学模型、工 作状态及、信号流程应用及信号流程。 第三章分析了了锁相环噪声的产生原因,并在数学模型上作了说明,并给出 了设计建议。 第四章是二阶环仿真源程序代码及仿真结果。

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第二章 锁相环的基本理论

锁相环作为一个系统, 主要包含三个基本模块: 鉴相器(Phase Detector: PD)、 低通滤波器(LowPass Filter:LPF),亦即环路滤波器(L00P Filter:LF),和压控振 荡器(Voltage Controlled Oscillator:VCO)。这三个基本模块组成的锁相环为基本 锁相环,亦即线形锁相环(LPLL),如图 2.1 所示。

图 2.1 锁相环原理图

当锁相环开始工作时,输入参考信号的频率 f1 与压控振荡器的固有振荡频 率 fo 总是不相同的,即 ?f ? f1 ? fo ,这一固有频率差 ?f ? f1 ? fo 必然引起它们之 间的相位差不断变化, 并不断跨越 2? 角。由于鉴相器特性是以相位差 2? 为周期 的, 因此鉴相器输出的误差电压总是在某一范围内摆动。这个误差电压通过环路 滤波器变成控制电压加到压控振荡器上,使压控振荡器的频率 fo 趋向于参考信 号的频率 f i , 直到压控振荡器的频率变化到与输入参考信号的频率相等,并满足 一定条件, 环路就在这个频率上稳定下来。两个频率之间的相位差不随时间变化 而是一个恒定的常数,这时环路就进入“锁定”状态。 当环路已处于锁定状态时,如果输入参考信号的频率和相位发生变化,通 过环路的控制作用, 压控振荡器的频率和相位能不断跟踪输入参考信号频率的变 化而变化,使环路重新进入锁定状态,这种动态过程称为环路的“跟踪”过程。 而环路不处于锁定和跟踪状态,这个动态过程称为“失锁”过程。 从上述分析可知,鉴相器有两个主要功能:一个是频率牵引,另一个是相位

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锁定。实际中使用的锁相环系统还包括放大器、分频器、混频器等模块,但是这 些附加的模块不会影响锁相环的基本工作原理,可以忽略。

2.1 锁相环的工作原理
锁相环作为一个系统,主要包含三个基本模块:鉴相器【4】 、低通滤波器,亦 即环路滤波器,和压控振荡器。在本节首先分析鉴相器、环路滤波器和压控振荡 器. 2.1.1 鉴相器 锁相环中的鉴相器(PD)通常由模拟乘法器组成,利用模拟乘法器组成的鉴 相器电路如图示:

U O (t )

U D (t )

U i (t )
图 2.2 模拟鉴相器电路

鉴相器的工作原理是: 设外界输入的信号电压和压控振荡器输出的信号电压分别 为:

ui (t ) ? Um sin[?i ? ?i (t )] uo (t ) ? Uom sin[?o ? ?o (t )]

(2.1)

(2.2)

式中的 ?O 为压控振荡器在输入控制电压为零或为直流电压时的振荡角频率,称 为电路的固有振荡角频率。则模拟乘法器的输出电压 U D 为:

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U D ? Kui (t )uo (t ) ? KU mU om sin[?it ? ?i (t )]cos[?ot ? ?o (t )]
? 1 KU mU om sin[?i t ? ?i (t ) ? ?ot ? ?ot ] 2

1 ? KU mU om sin{[?i t ? ?i (t )] ? [?ot ? ? ot ]} 2
(2.3) 鉴相器的传输特性为:

U d (t )

? e (t )
图 2.3 鉴相器的传输特性

鉴相器有两个主要功能:一个是频率牵引,另一个是相位锁定。实际中使用 的锁相环系统还包括放大器、分频器、混频器等模块,但是这些附的模块不会影 响锁相环的基本工作原理,可以忽略。 鉴相器的电路种类很多,大致可以分为四种常用类型: 1.乘法鉴相器。一般应用在模拟锁相环(LPLL)中,即线性锁相环,鉴相的 范围是[+90°,-90°]; 2.异或门鉴相器。较多应用于数字锁相环中,鉴相范围同为[+90°,-90°] 中, 要考虑鉴相器输入的两个信号是对称的还是非对称的,如是非对称还要考虑 其对 PLL 增益及锁相宽度的影响; 3.JK 触发器型鉴相器。这种鉴相器由边沿触发,利用边沿间的间隔进行鉴 相,相位误差为[+180°,-l80°]; 4.鉴频鉴相器(phase—frequency detector)。其优势就在于失锁时,它的角频 率容易描述。这种角频率的描述就可以实现鉴频的功能。鉴相范围为[+360°, -360°]。

2.1.2 低通滤波器

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低通滤波器(LF)的将上式 2.3 中的和频分量滤掉,剩下的差频分量作为压 控振荡器的输入控制电压 U c (t ) 。即为:
uc(t ) ? 1 KU mU om sin{[?i t ? ?i (t )] ? [?ot ? ? ot ]} 2

? U dm sin{(?i ? ?o )t ? [?i (t ) ? ?o (t )]}

(2.4)

式中的 ?1 为输入信号的瞬时振荡角频率, ?1 (t ) 和 ?2 (t ) 分别为输入信号和输出信 号的瞬时位相,根据相量的关系可得瞬时频率和瞬时位相的关系为:

? (t ) ?


d? (t ) dt

? (t ) ? ? ? (t )dt ? ? do

(2.5)

则,瞬时相位差 ?d 为

?d ? (?i ? ?o )t ? ?i (t ) ? ?o (t )

(2.6)

对两边求微分,可得频差的关系式为:

d? d d (?i ? ?o ) d [?i (t ) ? ?o (t )] ? ? dt dt dt

(2.7)

上式2.7等于零,说明锁相环进入相位锁定的状态,此时输出和输入信号的频率 和相位保持恒定不变的状态, ?c (t ) 为恒定值。当上式不等于零时,说明锁相环 的相位还未锁定,输入信号和输出信号的频率不等, ?c (t ) 随时间而变。其数学 模型为:

U d (t )

F (s)

U c (t )

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图2.4 环路滤波器模型

环路滤波器的分类: 1.RC积分滤波器。这是结构最简单的低通滤波器,它具有低通特性,且相位 滞后。当频率很高的时候,幅度趋于零,相位滞后接近于 ? 2 ; 2.无源比例积分滤波器; 3.有源比例积分滤波器。 它由运算放大器组成,高增益的有源比例积分滤波 器又称为理想积分滤波器。

2.1.3 压控振荡器

【6】 压控振荡器(VCO) 的压控特性如图 2.5 所示:

?u (t )

?o

U c (t )

2.5 压控振荡器特性

该特性说明压控振荡器的振荡频率 ?u 以为中心,随输入信号电压 U c (t ) 线性 地变化,变化的关系如下:

?u (t ) ? ?o ? Kouc (t )

(2.8)

上式说明当 U c (t ) 随时间而变时,压控振荡器(VCO)的振荡频率 ?u 也随时 间而变,锁相环进入“频率牵引”,自动跟踪捕捉输入信号的频率,使锁相环进 入锁定的状态,并保持 ?o ? ?1 的状态不变。

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2.2锁相环的工作状态

锁相环有四种工作状态,即锁定状态、失锁状态、捕获过程和跟踪过程【7】 。 1.锁定状态: 整个环路己经达到输入信号相位的稳定状态。它指输出信号相 位等于输入信号相位或者是两者存在一个固定的相位差,但频率相等。在锁定状 态时,压控振荡器的电压控制信号接近平缓。 2.失锁状态: 环路的反馈信号与锁相环输入信号的频率之差不能为零的稳状 态。 当环路的结构设计有问题, 或者是输入信号超出了锁相环的应用范围的时候 都会进入失锁状态。这个状态意味着坏路没有正常工作。 3.捕获过程: 指环路由失锁状态进入锁定状态的过程。这个状态表明环路已 经开始进入正常工作, 但是还没有达到锁定的稳态。此过程应该是一个频率和相 位误差不断减小的过程。 4.跟踪过程:是指在 PLL 环路处于锁定状态时,若此时输入信号频率或相位 因其它原因发生变化,环路能通过自动调节,来维持锁定状态的过程。由于输入 信号频率或者相位的变化引起的相位误差一般都不大, 环路可视作线性系统。 PLL 的这四种状态中,前两个状态称为静态,后两个状态称为动态【8】 。优秀的设计可 以使 PLL 在上电后立刻进入捕获状态,从而快速锁定。 一般用四个参数指标来描述 PLL 的系统频带性能: 1.同步带:它指的是环路能保持静态锁定状态的频率范围。当环路锁定时, 逐步增大输入频率,环路最终都能保持锁定的最大输入固有频差。 2.失锁带: 锁相环路稳定工作时的动态极限。也就是说 PLL 在稳定工作状态 时,输入信号的跳变要小于这个参数,PLL 才能快速锁定。若输入信号的跳变大 于该参数而小于捕获带,则环路还是能锁定,但是需要较长的时间。 3.捕获带: 只要反馈信号和输入信号的频差在这一范围内,环路总会通过捕 获而再次锁定, 随着捕获过程的进行,反馈信号的频率向着输入信号频率方向靠 近,经过一段时间后,环路进入快捕带过程,最终达到锁定。 4.快捕带:在此频差范围内,环路不需要经历周期跳跃就可达到锁定,实现 捕获过程。

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稳定度静态限制

稳定度动态限制

???H 同步范围 ???p 捕捉范围 ???po 拉出范围

???L 锁定范围
工作范围

?0

条件稳定 动态不稳定
2.6锁相环不同带宽捕获示意图
【5】

当相关频率变化比较小时,相位误差e大小将与频率的变换量 ?? 成比例。 而如果频率偏移 ?? 达到某一特定值时,稍有变换PLL将失去捕获相位的能力, 最终失锁。 这一特定值就称作PLL的同步带。这个频率范围也称作PLL稳定的静态 极限范围。在失锁时,相位误差 ? e 将无限增加下去,同步带内,信号的捕获时间 也是最长的。捕获的稳定性也较差。 频率阶跃信号作为输入信号进入PLL时( f ? 0 时刻频率阶跃的大小是 ? ? ), 如果此阶跃信号引起PLL的失锁,那么就称这个频率阶跃值为锁出频率值,这个 范围叫做锁相环出锁频率。这个阶跃信号频差值小于PLL的同步带。在这里,同 步带可以看作是频率缓慢变化到此范围使锁相环失锁的极值; 而出锁频率是突然 变化到此阶跃值而引起PLL失锁。而且出锁范围也可以理解为PLL稳定的动态范 围,在频率阶跃信号的跳变不超过出锁范围时PLL是满足稳定条件的。 如果有一频差值使得平均相位误差的斜率变小,且VCO输出的频率值会越来 越接近输入信号的频率,最终环路系统将重新锁定,这一关键值称作入锁频率。 假如输入信号频率与输出信号频率的偏移量 ? ? 低于捕获带,则PLL将要锁

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定。 这个过程称作快捕过程, 它快于入锁过程, 而这个捕获范围也小于入锁范围。 PLL捕获的过程包含频率捕获与相位捕获两个过程,通常频率捕获过程所需 要的时间称为频率捕获时间(或频率牵引时间); 相位捕获过程所需要的时间称为 快捕时间(或相位捕获时间)。 一般频率捕获时间总是大于相位捕获时间的,所以 常说的捕获时间就是指频率捕获时间,不考虑相位捕获时间的影响。

2.3 锁相环的非线性工作性能分析
当锁相环的相位误差大于 ? 6 时,正弦鉴相器将不再能够线性化,环路成为 非线性系统,其非线性性能表现为以下三种情况:已处于锁定状态的锁相环,当 输入信号频率或压控振荡器自由振荡频率变化过大或变化速度过快时, 使环路相 位误差增大到鉴相器的非线性区,这种非线性环路的性能为非线性跟踪性能【9】 ; 从接通到锁定的捕获过程中, 相位误差的变化范围是很大的,环路处于非线性状 态;失锁状态时环路的频率牵引现象。

2.3.1跟踪性能

环路非线性跟踪性能指标包括稳态相位误差见 ? e(?) 、 同步带 ??H 和最大同 步扫描速 RH ,在这里从环路动态方程对其进行分析。输入固定频率信号的条件 下,锁相环路的动态方程可变为:

p?e (t ) ? ??0 ? KF ( p) s i n ?e (t )

(2.9)

环路锁定时瞬时相差 P?e (t ) 等于零, 且鉴相器输出误差信号和压控振荡器控制信 号均为直流,由此可得环路的稳态相位误差为:

? e (? ) ? arcsin

?? 0 KF ( J 0)

(2.10)

上式 2.10 中 F ( jo ) 为环路滤波器的直流增益。理想二阶环的 F ( jo ) ? ? ,其稳态 相位误差为: ?e (?) ? ? 对于已经锁定的环路,缓慢增加其固有频率,环路如果

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还能保持锁定,则 ? e (?) 有解。使上式有解的环路固有频差的最大值就是环路的 同步带,即:

??H ? KF ( j0)
则可得理想二阶环路的同步带:
??H ? ?

(2.11)

(2.12)

上式2.12成立的前提是环路滤波器和压控振荡器都有无限大的线性工作范围, 这 是不符合实际的。 理想二阶环的同步带是有限的,它往往受限于压控振荡器的最 大控制范围。理想二阶环可以跟踪频率斜升信号,其稳态相位误差为 R

?n2

。加

大频率斜升信号的斜率R,就可能使环路进入非线性跟踪状态。进一步加大R,环 路就可能失锁。 使环路不致失锁的尺的最大值就是最大同步扫描速率。在输入频 率斜升信号的条件下有:
P ? 1 (t ) ? p ( Rt 2 ) ? Rt 2

(2.13)

把理想二阶坏的传输算子 F ( P ) 代入上式2.13可得锁定时坏路的相位误差为:

? e ? arcsin

R
2 ?n

(2.14)

2 当 R ? ?n 上式无解,意味着环路失锁,因此理想二阶环的最大同步扫描速率为:

2 RH ? ?n

(2.15)

2.3.2捕获性能

实际工作过程中, 锁相环初始状态往往是失锁状态。环路经由失锁进入锁定 状态,需要经历一个捕获过程。捕获过程分为频率捕获和相位捕获两个过程。在 相位捕获中环路相位误差不会发生 2? 周期跳跃,捕获时间比较短,因此相位捕 获也叫做快捕。与相位捕获相比,频率捕获时间较长,它构成了捕获时间的主要 部分。一般而言,捕获过程中环的瞬时相差将在大范围内变化,使捕获过程表现

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为一种非线性现象。 要想获得环路捕获性能的全部结果,需要求解环路非线性动 态方程, 二阶环路的动态方程是二阶非线性微分方程,在数学上是无法精确求解 的,只能用近似求解的方法求解。理想二阶环的方程为:

d 2?e (t ) d 2?1 (t ) ? d 1 ? ? K 1 [sin?e (t )] ? K sin ?e (t ) dt2 dt2 ? 1 dt ?1
设环路输入信号频率固定,则

(2.16)

d?1 (t)/d t ? ??0
代入并简化,可得理想二阶环轨迹方程:

d 2?1 (t)/d t2 ? 0

(2.17)

d? e (t ) sin[? e (t )] ] ? ? cos[? e (t )] ? ? d? (t ) K 2 d [? e (t )] dt ? 2[ e ] ?1 dt 1 d [

(2.18)

由上式可得到理想二阶环的捕获特性,如下表
2.6理想二阶环的捕获特性

捕获带

快补带

捕获时间
2 ??0

快补时间

最大捕获扫描率

?
限制。

2??n

5
3 2?? n

?? n

? n2

2

实际情况中环路的捕获带不会为无穷大【10】 ,它受到压控振荡器最大频率范围的

2.3.3失锁状态

锁相环失锁时,具有频率牵引现象。当环路失锁时,环路中误差电压为上下 不对称的周期性差拍信号, 此差拍电压的直流分量使压控振荡器的平均频率向输 入信号频率靠近,从而使环路输出信号的平均频差小于环路固有频差。

2.4锁相环的稳定性

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锁相环是一个负反馈系统,要工作正常,首先必须稳定,不稳定就不能实现 相位的自动调节。 通常的系统稳定性,是指系统在有限输入的作用下输出有限响 应。 对于线形系统而言, 其稳定性与输入信号的大小无关,只取决于系统传递函 数极点的位置。 线形系统稳定的必要和充分条件,是系统闭环传递函数的所有点 都具有负实部,或者说都位于s平面的左半部。 锁相环路本质是一个非线性系统,它的稳定性是一个非线性问题。非线性系 统的稳定性取决于系统本身和输入。因此,通常把非线性系统的稳定性分为强干 扰作用下和弱干扰作用下的稳定性问题,或者叫大稳定性和小稳定性问题。对于 锁相环来说,前者相当于环路失锁而处于捕获状态,后者相当于同步状态。对于 大稳定性问题,主要研究环路的捕捉问题。同步状态是环路的线形工作状态,所 以小稳定性问题实际上是一个线形系统的稳定性问题。 判断系统稳定性的方法,通常叫巴克豪森准则【11】 。对于一个反馈系统,如 果其环路增益超过1,同时环路相移超过 ? ,即同时满足起振的振幅条件和位条 件,那么此反馈系统是不稳定的,巴克豪森准则判断系统稳定性的条件是:

? 20 lg H 0 ( j? ) ? 0 ? ArgH ( j? ) ? ? 0 ?


? 20 lg H 0 ( j?T ) ? 0 ? ArgH ( j? ) ? ? 0 T ?

(2.19)

公式2.19中 ?T 是增益临界频率,为开环增益达到0dB时的频率。 ?K 相位临 界频率,为开环相移达到万时的频率。 对于闭环不稳定的环路必有对于闭环稳定的环路,必有ωT>ωK;闭环临界的 情况为 ?T ? ?K 。在工程中,闭环临界的稳定情况实际是不稳定的,因为实际电 路中总有引起各种参数变化的因素,产生附加相移,这些都会使一个临界稳定的 坏路不稳定。所以,实际使用的环路不但是稳定的而且要远离临界条件。这就是 “相位裕度”的问题,定义为丌环增益降至OdB时开环相移量与π 的差值,此概

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念可以说明环路稳定的程度。 在实际的锁相环电路中, 不可避免地存在一些寄生相移,它们引入了额外的 高频极点,不利于环路的稳定性。环路相位裕度的理论值太小,考虑到寄生相移 的影响,则实际相位裕度可能更小,会使环路不稳定。

2.5信号流程图

锁相环的原理框图如下:
UD

PD

LF

Uc

VCO

2.7 锁相环原理框图

其工作过程如下: 1 压控振荡器的输出 Uo 经过采集并分频; 2.输出和基准信号同时输入鉴相器; 3.鉴相器通过比较上述两个信号的频率差,然后输出一个直流脉冲电压 Ud; 4.Ud 进入到滤波器里面,滤除高频成分后得到信息 Ue; 5.Ue 进入到压控震荡器 VCO 里面,控制频率随输入电压线性地变化; 6.这样经过一个很短的时间,VCO 的输出就会稳定于某一期望值。

2.6 锁相环的优良特性

锁相环广泛应用于无线领域,是其自身具有较好的特性: 1.载波跟踪特性。 无论输入锁相环的信号是已调制好的或未调制的,只要信 号中包有载波 频率成分就可将环路设计成一个窄带跟踪滤波器,跟踪输入信号 载波成分的频率与相位变化, 环路输出信号就是需要提取 (或复制) 的载波信号。 这就是环路的载波跟踪特性。 载波跟踪特性包含这三重含义:一是窄带。环路可以有效地滤除输入信号伴

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随的噪声和干扰。 环路主要是利用环路滤波器的低通特性来实现输入信号的载频 上的窄带带通特性的,这比制作普通的窄带带通滤波器容易得多。在高载频上, 用锁相环路可将通带做到几赫兹那么窄,这是普通带通滤波器难以实现的。二是 跟踪。 环路可以在保持窄带特性的情况下跟踪输入载波频率的漂移。普通带通滤 波器的频率特性是固定的, 为了能接收载频漂移的输入信号,滤波器的通带带宽 必须设计漂移范围, 因而无法利用窄带特性来过滤噪声与干扰。三是可将弱输入 载波信号放大到强信号输出。 因为环路输出的是压控振荡器的信号,它是输入弱 载波信号频率与相位的真实复制品,其幅度则比输入信号强的多。 2.调制跟踪特性。 只要让环路有适当宽度的低频通带,压控振荡器输出信号 的频率与相位就能跟踪输入调频或调相信号的频率与相位的变化, 即得到输入角 调制信号的复制品,这就是调制跟踪特性。利用环路的调制跟踪特性,可以制成 角调制信号的调制器与解调器。 3.低门限特性。 锁相环路不像一般非线性器件那样, 门限取决于输入信噪比, 而是由环路信噪比决定的。 一般环路的通频带总比环路输入端的前置通频带窄的 多,因而环路信噪比明显高于输入信噪比,环路能在低输入信噪比条件下工作, 即具有低门限的优良特性。这样,只要将环路设计成窄带,就可把淹没在噪声中 的微弱信号提取出来。这样的环路用于解调调频、调相信号时,可取得门限扩展 的效果;用于解调数字调制信号时,可使误码率降低。

2.7锁相环的应用
2.7.1.锁相环在调制和解调中的应用 调频波的特点是频率随调制信号幅度的变化而变化。压控振荡器的振荡频率 取决于输入电压的幅度。 当载波信号的频率与锁相环的固有振荡频率 ?O 相等时, 压控振荡器输出信号的频率将保持 ?O 不变。若压控振荡器的输入信号除了有锁 相环低通滤波器输出的信号 U c 外,还有调制信号 Ui ,则压控振荡器输出信号的 频率就是以 ?O 为中心,随调制信号幅度的变化而变化的调频波信号。由此可得 调频电路可利用锁相环来组成,由锁相环组成的调频电路组成框图下图所示。

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调制信号
Ui Uc

晶振电路 载波 信号

鉴相器

低 通 滤波器

压 控 振荡器

调频信号
Uo

2.8 锁相环组成的调频电路

根据锁相环的工作原理和调频波的特点可得解调电路组成框图如图 2.8 所示。 2.7.2.锁相环在频率合成电路中的应用 在现代电子技术中, 为了得到高精度的振荡频率, 通常采用石英晶体振荡器。 但石英晶体振荡器的频率不容易改变, 利用锁相环、 倍频、 分频等频率合成技术, 可以获得多频率、 高稳定的振荡信号输出。输出信号频率比晶振信号频率大的称 为锁相倍频器电路; 输出信号频率比晶振信号频率小的称为锁相分频器电路。锁 相倍频和锁相分频电路的组成框图下图所示。

晶振电路

Ui fi

鉴相器

低 通 滤波器

压 控 振荡器

Uo

N

fo

2.8 锁相倍频和锁相分频电路 图中的 N 大于 1 时,为分频电路;当 0 ? N ? 1 时,为倍频电路。

2.8本章小结
本章对锁相环系统的基本原理及组成部件进行了概括介绍, 对锁相环系统的 捕获、跟踪性能,动态特性以及锁相环的自身特性等一些基本性能、概念给出了 相关说明, 指出锁相环路所以能够得到如此广泛的应用,是由其独特的优良性能 所决定的。它具有载波跟踪特性,作为一个窄带跟踪滤波器,提取淹没在噪声之 中的信号,在深空测控中有着广泛的应用。

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第三章锁相环的噪声分析

锁相环的输入信号和各个模块都包括了噪声源,其输出信号必然包含噪声。 噪声是锁相环的重要特性, 设计中必须考虑。本章节主要分析了输入信号的噪声 和压控振荡器的噪声。 在实际的工作过程中,压控振荡器的相位噪声是锁相环最 主要的噪声。

3.1 锁相环的输入噪声

如下所示,以采用 RC 错误!未找到引用源。积分滤波器的锁相环为例。设 输入和输出信号 ui (t ) ? Ui sin[?c ? ?in (t )] 和 ue (t ) ? Ue sin[?ct ? ?oul (t )] 。则由前面章 节可得出传输函数为:
H (s) ?
2 ?n 2 s 2 ? 2??n ? ?n

(3.1)

如果输入相位偏差 ?in (t ) 不随时间变化,即为纯正弦信号。当 s ? 0
2 时, H ( s) ? 1 。同样,假设 ?in (t ) 变化缓慢,则上式的分母会接近 ?n ,所以 H ( s ) 仍

然等于1,这表明输出相位跟随输入相位,或者说是输出频率跟随输入频率。 如果 ?in (t ) 变化非常快,上式表明输出相位偏差气, ?out (t ) 减小并最终为零, 使得 “ u0 (t ) ? U 0 sin ?ct , 即输入相位或者频率变化太快, 锁相环不能跟踪输信号。 输入信号的相位噪声被坏路中的低通滤波器整形最后出现在输出端。 为了减小噪 声,环路带宽应该尽量小,但这以降低锁定范围、限制捕获范围、降低稳定性为 代价。

3.2压控振荡器的噪声

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VCO的相位噪声可以被认为是一个外加信号 ? vco , 如下图3.1所示。 在此假设,

? in 和 ? out 是不相关的。假设 ? in =0,即表示输入信号的相位偏差为零,输入信号为
一个严格的周期信号。得到从 ? vco 到 ? oul 的传递函数:

?out (s) s(s ? ?LPF ) ? 2 ?vco (t ) s ? 2??n s ? ?ns

(3.2)

由上所得的输入噪声和传递函数有相同的极点, 但是它包括了两个零点 ?z1 ? 0 和

?z 2 ? ??LPF ,具有高通性。
原点上的零点表示,如果 ? vco 变化缓慢,则 ? out 很小。因为在锁定条件下, VC0的相位变化通过PD变成了电压,加到VCO的控制输入端,使相位朝相反的方向 变化。由于VCO的电压相位转变对缓慢变化的控制电压 VC 有无穷的增益,负反馈 抑制了输出相位变化。 PLL可以简化为下图结构:一个理想的积分器位于负反馈环中,在输入端 产生了一个“虚地’,因此,对于缓慢变化的 ? vco 。,则 ? out =0。

? in

? out

LPF

VCO

3.1图简单的锁相环VCO噪声模拟

假设 ? vco 变化很快,则

kvco

s

的大小,以及环路增益都相应减小,这样,也

会使“虚地”产生变化。当 ? in 变化接近 ?LPF ,环路增益由于低通滤波器而减小。 从公式(3.2)可知,当s→∞时,有 ?OUT ? ?VCO 。即 ? vco 当变化非常快时环 路相当于开环状态。 利用压控振荡器传递函数:,将电源加一个很小的阶跃q,则输出为:

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?OUT (t ) ? ?1 ?cos 1 ? ? 2 ?nt ?
? ? ? sin 1 ? ? 2 ?nt ? x exp(???nt ) 1? ? ?

?

(3.3)

由上式有时间常数为1/ ??n 。为了使PLL有快的锁定特性,尽量将 ??n 取大。 为了减小VCO的相位噪声的影响,环路带宽应该尽量取大,而这与抑制输 入相位噪声将环路噪声带宽尽量减小相矛盾。实际工程中,输入信号主要来自晶 体振荡器,噪声非常小,所以,PLL的输入相位噪声主要来自内部的VCO,因此 可以将环路带宽适当取大。

3.3相位噪声的抑制

锁相环的抖动主要是由相位噪声或边带引起的。 而产生随机抖动和相位噪声 的原因,可以简单认为是电源噪声、衬底噪声和器件噪声。边带则基本上是由控 制路径上的周期性扰动引起的。 结合实际,抖动产生的原因如有: 1.电源噪声和衬底噪声,引起了受电压影响的电容(如MOS管的Cgd)的变化, 导致振荡器频率的变化。 可以把电源和衬底也作为VCO的控制电压来分析VCO的频 率特性; 2.衬底噪声,衬底噪声会导致器件阈值电压 Vth 的改变; 3.器件噪声(热噪声、闪烁噪声),闪烁噪声随着振荡器(VCO)的频率慢慢变 化,它能够通过增加PLL的带宽来抑制。热噪声可以通过版图的方法减小。减小
1 噪声要增加器件面积。 f

在PLL设计过程中,应当尽量遵循以下原则来减小抖动: 1.将缓冲控制电压(buffered control voltage)作为电源电压。 2.用缓冲控制电压去产生偏置电流,电流源隔离。 3.采用Cascode电流源或镜像电流源,可以将敏感性降到O.5%。 4.用阱器件来做电流源和环路滤波电容。

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5.将控制电压做在阱上面(避免衬底的影响)。 6.控制电压仅与阱器件连接,不与引脚直接连接。

3.4 本章小结

本章对锁相环系统噪声进行了概括介绍,对锁相环系统的输入噪声,相位 噪声给出了相关说明及减小噪声的一些措施, 指出锁相环路设计中应该尽可能的 减小噪声带来的影响,实际意义很重要。

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第四章二阶锁相环仿真及结果

4.1 仿真介绍

仿真使用的软件是 MATLAB7.0。由于 MATLAB 仿真软件适合多学科、多 种工作平台且功能强大、界面友好、方便快捷、语言自然并且开放性强的大型优 秀应用软件, 已经也已成为国内外高等院校高等数学、 数值分析、 数字信号处理、 自动控制理论以及工程应用等课程的基本教学工具。使用 Matlab 对锁相环仿真 的实现是方便快捷的。 仿真所采有的是二阶锁相环。 这是由于我们实际应用中的绝大多数 PLL, 或 者是二阶的,或者是通过忽略高阶效应(至少在初步设计时)而被设计成近似的 二阶环路。鉴于二阶锁相环在实际应用的意义,所以在仿真采用了二阶锁相环。

4.2 程序代码

% File: c6_nltvde.m w2b=0; w2c=0; yd=0; y=0; tfinal = 50; fs = 100; delt = 1/fs; npts = 1+fs*tfinal; ydv = zeros(1,npts); yv = zeros(1,npts); % % initialize integrators % initialize differential equation % simulation time % sampling frequency % sampling period % number of samples simulated % vector of dy/dt samples % vector of y(t) samples

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% beginning of simulation loop for i=1:npts t = (i-1)*delt; if t<20 ydd = 4*exp(-t/2)-3*yd*abs(y)-9*y; else ydd = 4*exp(-t/2)-3*yd-9*y; end w1b=ydd+w2b; w2b=ydd+w1b; yd=w1b/(2*fs); w1c=yd+w2c; w2c=yd+w1c; y=w1c/(2*fs); ydv(1,i) = yd; yv(1,i) = y; end plot(yv,ydv) xlabel('y(t)') ylabel('dy/dt') % first integrator - step 1 % first integrator - step 2 % first integrator output % second integrator - step 1 % second integrator - step 2 % second integrator output % build dy/dt vector % build y(t) vector % end of simulation loop % plot phase plane % label x axis % label y zxis % End of script file. % File: pllpost.m % kk = 0; while kk == 0 k = menu('Phase Lock Loop Postprocessor',... 'Input Frequency and VCO Frequency',... 'Input Phase and VCO Phase',... 'Frequency Error','Phase Error','Phase Plane Plot',... 'Phase Plane and Time Domain Plots','Exit Program'); % de for t>=20 % de for t<20 % time

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if k == 1 plot(t,fin,'k',t,fvco,'k') title('Input Frequency and VCO Freqeuncy') xlabel('Time - Seconds');ylabel('Frequency - Hertz');pause elseif k ==2 pvco=phin-phierror;plot(t,phin,t,pvco) title('Input Phase and VCO Phase') xlabel('Time - Seconds');ylabel('Phase - Radians');pause elseif k == 3 plot(t,freqerror);title('Frequency Error') xlabel('Time - Seconds');ylabel('Frequency Error - Hertz');pause elseif k == 4 plot(t,phierror);title('Phase Error') xlabel('Time - Seconds');ylabel('Phase Error - Radians');pause elseif k == 5 ppplot elseif k == 6 subplot(211);phierrn = phierror/pi; plot(phierrn,freqerror,'k');grid; title('Phase Plane Plot');xlabel('Phase Error /Pi'); ylabel('Frequency Error - Hertz');subplot(212) plot(t,fin,'k',t,fvco,'k');grid title('Input Frequency and VCO Freqeuncy') xlabel('Time - Seconds');ylabel('Frequency - Hertz');subplot(111) elseif k == 7 kk = 1; end end % End of script file. % File: pllpre.m %

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clear all disp(' ') % be safe % insert blank line

fdel = input('Enter the size of the frequency step in Hertz > '); fn = input('Enter the loop natural frequency in Hertz > '); lambda = input('Enter lambda, the relative pole offset > '); disp(' ') disp('Accept default values:') disp(' zeta = 1/sqrt(2) = 0.707,') disp(' fs = 200*fn, and') disp(' tstop = 1') dtype = input('Enter y for yes or n for no if dtype == 'y' zeta = 1/sqrt(2); fs = 200*fn; tstop = 1; else zeta = input('Enter zeta, the loop damping factor > '); fs = input('Enter the sampling frequency in Hertz > '); tstop = input('Enter tstop, the simulation runtime > '); end npts = fs*tstop+1; t = (0:(npts-1))/fs; nsettle = fix(npts/10); tsettle = nsettle/fs; % % number of simulation points % default time vector % set nsettle time as 0.1*npts % set tsettle > ','s');

% The next two lines establish the loop input frequency and phase % deviations. fin = [zeros(1,nsettle),fdel*ones(1,npts-nsettle)]; phin = [zeros(1,nsettle),2*pi*fdel*t(1:(npts-nsettle))]; disp(' ') % insert blank line % end of script file pllpre.m

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% File: pll2sin.m w2b=0; w2c=0; s5=0; phivco=0; twopi=2*pi; twofs=2*fs; G=2*pi*fn*(zeta+sqrt(zeta*zeta-lambda)); a=2*pi*fn/(zeta+sqrt(zeta*zeta-lambda)); a1=a*(1-lambda); a2 = a*lambda; phierror = zeros(1,npts); fvco=zeros(1,npts); % beginning of simulation loop for i=1:npts s1=phin(i) - phivco; s2=sin(s1); s3=G*s2; s4=a1*s3; s4a=s4-a2*s5; w1b=s4a+w2b; w2b=s4a+w1b; s5=w1b/twofs; s6=s3+s5; w1c=s6+w2c; w2c=s6+w1c; phivco=w1c/twofs; phierror(i)=s1; fvco(i)=s6/twopi; end % end of simulation loop freqerror=fin-fvco; % build frequency error vector % End of script file. function [] = pplane(x,y,nsettle) % loop filter integrator input % filter integrator (step 1) % filter integrator (step 2) % generate fiter output % VCO integrator input % VCO integrator (step 1) % VCO integrator (step 2) % generate VCO output % build phase error vector % build VCO input vector % phase error % sinusoidal phase detector %initialize % define 2*pi % define 2*fs % set loop gain % set filter parameter % define constants % initialize vector % initialize vector

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% Plots the phase plane with phase in the range (-pi,pi) ln = length(x); maxfreq = max(y); minfreq = min(y); close axis([-1 1 1.1*minfreq 1.1*maxfreq]); hold on j = nsettle; while j < ln i = 1; while x(j) < pi & j < ln a(i) = x(j)/pi; b(i) = y(j); j = j+1; i = i+1; end plot(a,b,'k') a = []; b = []; x = x - 2*pi; end hold off title('Phase-Plane Plot') xlabel('Phase Error / Pi') ylabel('Frequency Error in Hertz') grid % End of script file. % File: ppplot.m % ppplot.m is the script file for plotting phase plane plots. If the % phase plane is constrained to (-pi,pi) ppplot.m calls pplane.m. kz = 0; % Old figure discarded % Establish scale % Collect info for new fig

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while kz == 0 k = menu('Phase Plane Options',... 'Extended Phase Plane',... 'Phase Plane mod(2pi)',... 'Exit Phase Plane Menu'); if k == 1 phierrn = phierrn/pi; plot(phierrn,freqerror,'k') title('Phase Plane Plot') xlabel('Phase Error /Pi') ylabel('Frequency Error - Hertz') grid pause elseif k == 2 pplane(phierrn,freqerror,nsettle+1) pause elseif k == 3 kz = 1; end end % End of script file.

4.3 仿真结果

图 4.1 锁相环处理框

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上图是利用 MATLAB 提供的函数将计算结果图形化功能建立的。在运行程 序后, 就会出现上面的对话框, 点击点击其中的任何一项就会出现相应的仿真图 形。上图中包含了输入频率和 VCO 频率,输入相位和 VCO 相位,频率误差, 相位误差,相位空间波特图,相位空间和时域,退出程序等选项。 运行程序后出现如下指令: Accept the tentative values: the first loop frequency is 5 Enter y for yes or n for no > y Enter the loop gain >40 Enter the sampling frequency in Hertz > 1200 Enter tstop, the simulation runtime > 5 第一循环频率 输入环路增益为 40 输入采样频率 仿真时间为 5 秒

设置好参数后运行程序,由上我们可知环路增益为 40,仿真时间为 5s,采样频 率为 1200Hz。接着点击上图 4.1 中的菜单,就能得到如下仿真图像。其中我们 主要观察输入相位和 VCO 相位。

图 4.2 输入相位和 VCO 相位

图 4.3 相位误差图

图 4.2 中蓝线为输入相位,绿线代表 VCO 相位,从图中可以看见随着时间 的变化输入信号相位为线性,而 VCO 相位则是经历了一段曲线后斜率与输入信 号相位斜率相同,输出相位跟随输入相位,达到稳定。图 4.3 中 VCO 的相位也 是先经历了一段时间的曲线后变为一条直线达到稳定。 根据锁相环的基本原理我 们可知锁相环是个反馈网络,它是由输出信号(VCO 产生)与参考频率在频率 和相位上保持同步或者保持常数。由此我们可以看出锁相环工作后,在最初的一 段时间中锁相环开始工作,输入信号经过鉴相器,环路虑波器后,将输出相位反

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馈给 VCO 压控振荡器, 使压控振荡器与输入频率逐步实现同步, 保持一个常数, 实现锁定。其中经历了锁相环的失锁、跟踪、捕获、锁定,从而达到最后达到稳 定状态。从开始到达到稳定的这段时间则为做捕获时间。

图 4.4 频率差图

图 4.5 输入频率和 VCO 频率图

图 4..4 与图 4.5 也显示了锁相环工作后从失锁、跟踪、捕获、锁定的过程, 过程。从不停的摆动到最后的直线状态,这个过程称为锁定过程。其中我们可以 发现在捕捉过程中随着捕捉次数的增加,捕捉过程也变得较慢,这说明此时的的 锁相环工作平率处在稳定工作的动态界限内,工作正常。

4.4 本章小结

本章介绍了仿真的环境以及二阶锁相环的仿真过程, 并对其仿真结果进行了 分析。在前三章的理论基础上,通过使用 MATLAB7.0 进行了仿真。实验结果表 明:用 MATLAB 进行的二阶锁相环仿真达到了最初的设想,锁相环的失锁、跟 踪、捕获、锁定各个阶段均有体现。达到了最初仿真的要求。

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本文在阅读一些文献和对锁相环有一定程度了解的基础上, 运用MATLAB进行 了仿真。本文完成了以下工作: 1.在掌握了锁相环的基本原理并对文献研究的基础上, 对锁相环的工作原理 进行了深入的分析, 深入了解锁相环技术的数学分析方法,应用此方法得到锁相 环技术的数学模型,用这些理论指导实际中的设计工作。 2.在对基本原理和电路结构确定的基础上, 将锁相环的整体电路进行层次化 分解,即鉴频鉴相器、低通滤波器、压控振荡器,并对各个模块的工作原理和性 能进行了比较详细的分析。 3.用MATLAB软件对设计的锁相环电路进行了模拟仿真, 验证了电路功能的正 确与否,以及锁相环的设计目标是否达到。 由于时间和条件的限制, 在设计工作中有些工作没有做到,留待进一步的完 善,后续工作是: 1.在运用MATLAB设计锁相环时,并没有引入噪声对锁相环的影响及相应的分 析,也未对锁相环的各项参数进行深入的讨论。 2.仅限于对锁相环理论的研究与分析上, 并没有针对其实际中的应用研究相 关的了解。 3.在此次仿真中只对二阶锁相环进行了仿真, 并没有对其他锁相环进行仿真 和研究,也没有进行硬件实现。 目前锁相环技术在通信中早已成熟,随着科技的发展,目前的锁相环都是基 于半导体工艺的集成电路。 对于未来而言, 用锁相环的集成化设计减小相应噪声、 提高锁相环的频率预测精度、 硬件系统的运算速率以及降低干扰也是其研究的一 个重要方向。

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经过半年的忙碌和工作, 本次毕业设计已经接近尾声,作为一个本科生的毕 业设计,由于经验的匮乏,难免有许多考虑不周全的地方,如果没有导师的督促 指导,以及一起的同学们的支持,想要完成这个设计是难以想象的。 在这里首先要感谢我的导师李立欣老师。李立欣老师平日里工作繁多,但在 我做毕业设计的每个阶段,从开始的查阅资料,设计的确定和修改,中期检查, 后期初稿的修改到完稿等整个过程中都给予了我悉心的指导。 我的设计较为复杂 烦琐, 但是李老师仍然细心地纠正论文中的错误。 除了敬佩李老师的专业水平外, 他的治学严谨和科学研究的精神也是我永远学习的榜样, 并将积极影响我今后的 学习和工作。 然后还要感谢大学四年来所有的老师,为我们打下电子信息方面的基础;同 时还要感谢所有的同学们, 正是因为有了你们的支持和鼓励。此次毕业设计才会 顺利完成。 最后感谢工学院和我的母校—西工大明德学院大学四年来对我的大力栽培。

何 鹏 2010 年 5 月

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参考文献

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出版社,2007.4 [10] 吴大正 , 杨林耀 , 张永瑞等 , 信号与线性系统分析 ( 第三版 ), 高等教育出版

社,1998 [11] 毕查德· 拉扎维著,陈贵灿,程军,张瑞智等译,模拟CMOS集成电路设计,西安

交通大学出版社,2003,284-287

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毕业设计小结

通过此次毕业设计,我不仅把知识融会贯通,而且丰富了大脑,同时在查找 资料的过程中也了解了许多课外知识, 开拓了视野, 认识了将来电子的发展方向, 使自己在专业知识方面和动手能力方面有了质的飞跃。 毕业设计是我作为一名学生即将完成学业的最后一次作业, 他既是对学校所 学知识的全面总结和综合应用, 又为今后走向社会的实际操作应用铸就了一个良 好开端, 毕业设计是我对所学知识理论的检验与总结,能够培养和提高设计者独 立分析和解决问题的能力; 是我在校期间向学校所交的最后一份综和性作业,从 老师的角度来说, 指导做毕业设计是老师对学生所做的最后一次执手训练。 其次, 毕业设计的指导是老师检验其教学效果,改进教学方法,提高教学质量的绝好机 会。 毕业的时间一天一天的临近,毕业设计也接近了尾声。在不断的努力下我的 毕业设计终于完成了。 在没有做毕业设计以前觉得毕业设计只是对这几年来所学 知识的大概总结, 但是真的面对毕业设计时发现自己的想法基本是错误的。毕业 设计不仅是对前面所学知识的一种检验,而且也是对自己能力的一种提高。通过 这次毕业设计使我明白了自己原来知识太理论化了, 面对单独的课题的是感觉很 茫然。自己要学习的东西还太多,以前老是觉得自己什么东西都会,什么东西都 懂,有点眼高手低。通过这次毕业设计,我才明白学习是一个长期积累的过程, 在以后的工作、生活中都应该不断的学习,努力提高自己知识和综合素质。 总之,不管学会的还是学不会的的确觉得困难比较多,真是万事开头难,不 知道如何入手。最后终于做完了有种如释重负的感觉。此外,还得出一个结论: 知识必须通过应用才能实现其价值!有些东西以为学会了,但真正到用的时候才 发现是两回事,所以我认为只有到真正会用的时候才是真的学会了。 在此要感谢我们的指导老师李老师对我悉心的指导,感谢老师们给我的帮 助。在设计过程中,我通过查阅大量有关资料,与同学交流经验和自学,并向老

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师请教等方式,使自己学到了不少知识,也经历了不少艰辛,但收获同样巨大。 在整个设计中我懂得了许多东西,也培养了我独立工作的能力,树立了对自己工 作能力的信心, 相信会对今后的学习工作生活有非常重要的影响。而且大大提高 了动手的能力, 使我充分体会到了在创造过程中探索的艰难和成功时的喜悦。虽 然这个设计做的也不太好, 但是在设计过程中所学到的东西是这次毕业设计的最 大收获和财富,使我终身受益。

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